參數(shù)資料
型號： IDT71016S12YG
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： Replaced by SN74ABT2240A : Octal Buffers And Line/MOS Drivers With 3-State Outputs 20-PDIP -40 to 85
中文描述： 64K X 16 STANDARD SRAM, 12 ns, PDSO44
封裝： 0.400 INCH, ROHS COMPLIANT, PLASTIC, SOJ-44
文件頁數(shù)： 5/9頁
文件大?。?/td> 482K
代理商： IDT71016S12YG
6.42
IDT71016, CMOS Static RAM
1 Meg (64K x 16-bit) Commercial and Industrial Temperature Ranges
AC Electrical Characteristics
(
V
Commercial and Industrial Range
)
5
Timing Waveform of Read Cycle No. 1
(1,2,3)
NOTES:
1.
WE
is HIGH for Read Cycle.
2. Device is continuously selected,
CS
is LOW.
3.
OE
,
BHE
, and
BLE
are LOW.
DATA
OUT
ADDRESS
3210 drw 06
t
RC
t
AA
t
OH
t
OH
DATA
OUT
VALID
PREVIOUS DATA
OUT
VALID
,
NOTE:
1. This parameter is guaranteed with the AC Load (Figure 2) by device characterization, but is not production tested.
71016S12
71016S15
71016S20
Symbol
Parameter
Min.
Max.
Mn.
Max.
Min.
Max.
Unit
READ CYCLE
t
RC
Read Cycle Time
12
____
15
____
20
____
ns
t
AA
Address Access Time
____
12
____
15
____
20
ns
t
ACS
Chip Select Access Time
____
12
____
15
____
20
ns
t
CLZ
(1)
Chip Select Low to Output in Low-Z
4
____
5
____
5
____
ns
t
CHZ
(1)
Chip Select High to Output in High-Z
____
6
____
6
____
8
ns
t
OE
Output Enable Low to Output Valid
____
7
____
8
____
10
ns
t
OLZ
(1)
Output Enable Low to Output in Low-Z
0
____
0
____
0
____
ns
t
OHZ
(1)
Output Enable High to Output in High-Z
____
6
____
6
____
8
ns
t
OH
Output Hold from Address Change
4
____
4
____
5
____
ns
t
BE
Byte Enable Low to Output Valid
____
7
____
8
____
10
ns
t
BLZ
(1)
Byte Enable Low to Output in Low-Z
0
____
0
____
0
____
ns
t
BHZ
(1)
Byte Enable High to Output in High-Z
____
6
____
6
____
8
ns
WRITE CYCLE
t
WC
Write Cycle Time
12
____
15
____
20
____
ns
t
AW
Address Valid to End of Write
9
____
10
____
12
____
ns
t
CW
Chip Select Low to End of Write
9
____
10
____
12
____
ns
t
BW
Byte Enable Low to End of Write
9
____
10
____
12
____
ns
t
AS
Address Set-up Time
0
____
0
____
0
____
ns
t
WR
Address Hold from End of Write
0
____
0
____
0
____
ns
t
WP
Write Pulse Width
9
____
10
____
12
____
ns
t
DW
Data Valid to End of Write
7
____
8
____
10
____
ns
t
DH
Data Hold Time
0
____
0
____
0
____
ns
t
OW
(1)
Write Enable High to Output in Low-Z
1
____
1
____
1
____
ns
t
WHZ
(1)
Write Enable Low to Output in High-Z
____
6
____
6
____
8
ns
3210 tbl 10
相關PDF資料
PDF描述
IDT71016S12YI CMOS Static RAM 1 Meg (64K x 16-Bit)
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IDT71016S15Y CMOS Static RAM 1 Meg (64K x 16-Bit)
IDT71016S15YG CMOS Static RAM 1 Meg (64K x 16-Bit)
IDT71016S15YI Octal Buffers And Line/MOS Drivers With 3-State Outputs 20-SOIC -40 to 85
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