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參數(shù)資料
| 型號(hào)： | IDT70T3599S166DRI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類(lèi)： | DRAM |
| 英文描述： | HIGH-SPEED 2.5V 256/128/64K x 36 SYNCHRONOUS DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE |
| 中文描述： | 128K X 36 DUAL-PORT SRAM, 12 ns, PQFP208 |
| 封裝： | 28 X 28 MM, 3.50 MM HEIGHT, PLASTIC, QFP-208 |
| 文件頁(yè)數(shù)： | 18/28頁(yè) |
| 文件大?。?/td> | 442K |
| 代理商： | IDT70T3599S166DRI |
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6.42
IDT70T3519/99/89S
High-Speed 2.5V 256/128/64K x 36 Dual-Port Synchronous Static RAM Industrial and Commercial Temperature Ranges
Timing Waveform of Pipelined Read with Address Counter Advance
(1)
ADDRESS
An
CLK
DATA
OUT
Qx - 1
(2)
Qx
Qn
Qn + 2
(2)
Qn + 3
ADS
CNTEN
t
CYC2
t
CH2
t
CL2
5666 drw 15
t
SA
t
HA
t
SAD
t
HAD
t
CD2
t
DC
READ
EXTERNAL
ADDRESS
READ WITH COUNTER
COUNTER
HOLD
t
SAD
t
HAD
t
SCN
t
HCN
READ
WITH
COUNTER
Qn + 1
NOTES:
1.
CE
0
,
OE
,
BE
n = V
IL
; CE
1
, R/
W
, and
REPEAT
= V
IH
.
2. If there is no address change via
ADS
= V
IL
(loading a new address) or
CNTEN
= V
IL
(advancing the address), i.e.
ADS
= V
IH
and
CNTEN
= V
IH
, then
the data output remains constant for subsequent clocks.
Timing Waveform of Flow-Through Read with Address Counter Advance
(1)
ADDRESS
An
CLK
DATA
OUT
Qx
(2)
Qn
Qn + 1
Qn + 2
Qn + 3
(2)
Qn + 4
ADS
CNTEN
t
CYC1
t
CH1
t
CL1
5666 drw 16
t
SA
t
HA
t
SAD
t
HAD
READ
EXTERNAL
ADDRESS
READ WITH COUNTER
COUNTER
HOLD
t
CD1
t
DC
t
SAD
t
HAD
t
SCN
t
HCN
READ
WITH
COUNTER
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT70T3589S166BF | HIGH-SPEED 2.5V 256/128/64K x 36 SYNCHRONOUS DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE |
| IDT70T3589S-166BF | HIGH-SPEED 2.5V 256/128/64K x 36 SYNCHRONOUS DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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