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參數(shù)資料
| 型號(hào)： | IDT5V927 |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | Quad Output Clock Generator |
| 中文描述： | 四路輸出時(shí)鐘發(fā)生器 |
| 文件頁(yè)數(shù)： | 1/6頁(yè) |
| 文件大?。?/td> | 48K |
| 代理商： | IDT5V927 |
1
IDT5V927
QUAD OUTPUT CLOCK GENERATOR
INDUSTRIAL TEMPERATURE RANGE
FEBRUARY 2003
2003 Integrated Device Technology, Inc.
DSC 5853/6
c
IDT5V927
INDUS T RIAL T E MPE RAT URE RANGE
QUAD OUTPUT
CLOCK GENERATOR
FUNCTIONAL BLOCK DIAGRAM
DE S CRIPT ION:
The IDT5V927 is a low-cost, low skew, low jitter, and high-performance
clock synthesizer. It has been specially designed to interface with Gigabit
Ethernet (125MHz), Fibre Channel (106.25MHz), and OC-3 (155.52MHz)
applications. It can be programmed to provide output frequencies ranging
from50MHz to 160MHz, with input frequencies ranging from6.25MHz to
80MHz.
The IDT5V927 includes an internal RC filter that provides excellent jitter
characteristics and elimnates the need for external components. When
using the optional crystal input, the chip accepts a 10 - 40MHz fundamental
mode crystal with a maximumequivalent series resistance of 50
.
X2
X1
CRYSTAL
OSCILLATOR
PHASE
DETECTOR
CHARGE
PUMP
LOOP
FILTER
VCO
SELECT MODE
Q
0
Q
3
S1
S0
OE
0
1
Q
1
Q
2
REF
VCO DIVIDE
1/N
FEATURES:
3V to 3.6V operating voltage
50MHz to 160MHz output frequency range
Input from fundamental crystal oscillator or external source
Internal PLL feedback (loading feedback output relative to
other outputs, adjusts propagation delay between REF inputs
and outputs)
Select inputs (S
[1:0]
) for FB divide selection (multiply ratio of 2,
3, 4, 4.25, 5, 6, 6.25, and 8)
Low jitter
PLL bypass for testing and power-down control (S1 = H, S0 = H,
powers part down <500
μ
A)
Available in TSSOP package
APPLICATIONS:
Gigabit ethernet
Router
Network switches
SAN
Instrumentation
Fibre channel
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
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