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參數(shù)資料
| 型號(hào)： | IDT5V2310NRI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時(shí)鐘及定時(shí) |
| 英文描述： | 2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER |
| 中文描述： | 5V SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC20 |
| 封裝： | PLASTIC, QFN-20 |
| 文件頁數(shù)： | 6/8頁 |
| 文件大?。?/td> | 57K |
| 代理商： | IDT5V2310NRI |
6
INDUSTRIAL TEMPERATURE RANGE
IDT5V2310
2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER
OUTPUT ENABLE GLITCH SUPPRESSION CIRCUIT
The purpose of the glitch suppression circuitry is to ensure the output enable sequence is synchronized with the clock input such that the output buffer will be
enabled on the next full period of the input clock (negative edge triggered by the input clock). The G input must be stable one t
EN
- time prior to the falling edge
of the CLK for predictable operation.
CLK
t
EN
t
DIS
Gx
Yx
G (t
EN
, t
DIS
) Relative to CLK
↓
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT5V2310PG | 2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER |
| IDT5V2310PGI | 2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER |
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| IDT5V2528APG | 2.5V / 3.3V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER |
| IDT5V2528PG | 2.5V / 3.3V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| IDT5V2310PGG | 功能描述:IC CLK BUFF 1:10 200MHZ 24-TSSOP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:- 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件 |
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