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參數資料
| 型號： | IDT5T9820NLI8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 4/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK DRIVER ZD PLL 68-VFQFPN |
| 產品變化通告： | Product Discontinuation 05/Jan/2011 |
| 標準包裝： | 2,500 |
| 類型： | PLL 時鐘驅動器 |
| PLL： | 帶旁路 |
| 輸入： | eHSTL，HSTL，LVPECL，LVTTL |
| 輸出： | eHSTL，HSTL，LVTTL |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:10 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 5T9820NLI8 |
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12
INDUSTRIALTEMPERATURERANGE
IDT5T9820
EEPROM PROGRAMMABLE 2.5V ZERO DELAY PLL CLOCK DRIVER
DIFFERENTIAL INPUT AC TEST CONDITIONS FOR eHSTL
Symbol
Parameter
Value
Units
VDIF
Input Signal Swing(1)
1V
VX
DifferentialInputSignalCrossingPoint(2)
900
mV
VTHI
InputTimingMeasurementReferenceLevel(3)
CrossingPoint
V
tR, tF
InputSignalEdgeRate(4)
1
V/ns
NOTES:
1. The 1V peak-to-peak input pulse level is specified to allow consistent, repeatable results in an automatic test equipment (ATE) environment. This device meets the VDIF (AC)
specification under actual use conditions.
2. A 900mV crossing point level is specified to allow consistent, repeatable results in an automatic test equipment (ATE) environment. This device meets the VX specification under
actual use conditions.
3. In all cases, input waveform timing is marked at the differential cross-point of the input signals.
4. The input signal edge rate of 1V/ns or greater is to be maintained in the 20% to 80% range of the input waveform.
POWER SUPPLY CHARACTERISTICS FOR eHSTL OUTPUTS(1)
Symbol
Parameter
Test Conditions(2)
Typ.
Max
Unit
IDDQ
Quiescent VDD Power Supply Current(3)
VDDQN = Max., REF = LOW, PD = HIGH, nSOE = LOW,
112
150
mA
PLL_EN = HIGH, Outputs enabled, All outputs unloaded
IDDQQ
Quiescent VDDQN Power Supply Current(3)
VDDQN = Max., REF = LOW, PD = HIGH, nSOE = LOW,
3
75
A
PLL_EN = HIGH, Outputs enabled, All outputs unloaded
IDDPD
Power Down Current
VDD = Max., PD = LOW, nSOE = LOW, PLL_EN = HIGH
0.7
3
mA
IDDD
Dynamic VDD Power Supply
VDD = Max., VDDQN = Max., CL = 0pF
22
30
A/MHz
CurrentperOutput
IDDDQ
Dynamic VDDQN Power Supply
VDD = Max., VDDQN = Max., CL = 0pF
22
30
A/MHz
CurrentperOutput
ITOT
Total Power VDD Supply Current(4,5)
VDDQN = 1.8V, FVCO = 100MHz, CL = 15pF
280
400
mA
VDDQN = 1.8V, FVCO = 250MHz, CL = 15pF
320
450
ITOTQ
Total Power VDDQN Supply Current(4,5)
VDDQN = 1.8V, FVCO = 100MHz, CL = 15pF
160
250
mA
VDDQN = 1.8V, FVCO = 250MHz, CL = 15pF
280
400
NOTES:
1. These power consumption characteristics are for all the valid input interfaces and cover the worst case input and output interface combinations.
2. The termination resistors are excluded from these measurements.
3. If the differential input interface is used, the true input is held LOW and the complementary input is held HIGH.
4. Bit 60 = 1.
5. All outputs are at the same interface level.
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