參數(shù)資料
型號： IDT5T940-30NLI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： PRECISION CLOCK GENERATOR OC-192 APPLICATIONS
中文描述： 5T SERIES, PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC28
封裝： PLASTIC, VFQFPN-28
文件頁數(shù)： 7/10頁
文件大?。?/td> 68K
代理商： IDT5T940-30NLI
7
INDUSTRIAL TEMPERATURE RANGE
IDT5T940
PRECISION CLOCK GENERATOR OC-192 APPLICATIONS
INPUT TIMING REQUIREMENTS
Symbol
REF
H
F
REF
REF
TOL
F
CLKIN
CLKIN
H
t
AQ
LOCK
TOL
t
JIT
(
TOL
)
Parameter
Input Reference Clock Duty Cycle
Input Reference Clock Range
Input Reference Clock Frequency Tolerance
Clock in Frequency Range
Clock in Duty Cycle
Acquisition Time fromReturn of Valid CLKIN
Frequency Tolerance for LOCK
Tolerance to Input Jitter
Min.
40
19.44
-100
19.44
40
—
-600
Typ.
50
—
—
—
50
60
±450
Max.
60
666.52
100
666.52
60
150
600
Unit
%
MHz
ppm
MHz
%
us
ppm
GR-253 Sect. 5.6.2.2
Symbol
Parameter
Min.
155.52
155.52
622.08
19.44
19.44
—
—
—
—
—
65
—
—
—
45
Typ.
—
—
—
—
—
150
100
150
100
10
80
—
0.3
1
—
Max.
166.63
666.52
666.52
666.52
667
—
—
—
—
20
120
0.1
0.65
2
55
Unit
SELmode = LOW
SELmode = MID
SELmode = HIGH
Q
OUT
Multiplied Clock Output Frequency
MHz
Q
REG
CLKIN
t
R
Regenerated Clock Output Frequency
Input Clock Frequency
Output Rise Time
MHz
MHz
ps
LVPECL
LVDS
LVPECL
LVDS
t
F
Output Fall Time
ps
t
SK
Skew between Q
OUT
and Q
REG
PLL Bandwidth Setting
Jitter Transfer Peaking
Jitter Generation
(1)
(with 50KHz to 80MHz band pass filter)
Output Duty Cycle
ps
KHz
dB
PLLBW
t
P
t
J
Output Frequency = 622MHz - 666.5MHz
Output Frequency = 155.5MHz - 166.6MHz
ps (RMS)
t
DUTY
%
AC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE (OC-192)
NOTE:
1. All input frequencies and PLLBW
[1:0]
permtted by PLL Bandwidth Selection table.
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE FOR LVDS
Symbol
Input Characteristics
Parameter
Min.
Typ.
Max.
Unit
I
IN
V
CM
V
DIF
Output Characteristics
Input Current (CLKIN, REFIN)
Common Mode Input Voltage Range
(1)
Differential Voltage Required to Toggle Input
V
DD
= 3.465V
-20
0.9
100
—
—
—
+20
μ
A
V
mV
V
DD
- 0.05
—
V
OT(+)
V
OT(-)
V
OT
V
OS
V
OS
I
OS
I
OSD
Differential Output Voltage for the TRUE Binary State
Differential Output Voltage for the FALSE Binary State
Change in V
OT
Between Complementary Output States
Output Common Mode Voltage (Offset Voltage)
Change in V
OS
Between Complementary Output States
Outputs Short Circuit Current
Differential Outputs Short Circuit Current
247
-247
—
1.125
—
—
—
—
—
—
1.2
—
9
6
454
-454
50
1.375
50
24
12
mV
mV
mV
V
mV
mA
mA
V
OUT(+)
and V
OUT(-)
= 0V
V
OUT(+)
= V
OUT(-)
NOTE:
1. Not to exceed V
DD
- 0.05V.
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PDF描述
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