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參數(shù)資料
| 型號： | IDT5T940-30NLGI8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/13頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GENERATOR PREC 28-VFQFPN |
| 標準包裝： | 500 |
| 類型： | 時鐘/頻率發(fā)生器，多路復用器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH |
| 輸入： | LVDS，LVPECL，LVTTL |
| 輸出： | LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 666.52MHz |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 28-VFQFPN（6x6） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 5T940-30NLGI8 |
1
INDUSTRIALTEMPERATURERANGE
IDT5T940
PRECISION CLOCKGENERATOROC-192APPLICATIONS
2013
Integrated Device Technology, Inc.
DSC 6195/27
c
IDT5T940
INDUSTRIAL TEMPERATURE RANGE
PRECISION CLOCK GENERATOR
OC-192 APPLICATIONS
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
FEATURES:
Input frequency:
- ForSONETnon-FEC:19.44MHz,38.88MHz,77.76MHz,155.52MHz,
311.04MHz, or 622.08MHz
- For SONET FEC: 20.83MHz, 41.66MHz, 83.31MHz, 166.63MHz,
333.26MHz, or 666.52MHz
- For 10GE copper: 19.53MHz, 39.06MHz, 78.125MHz, 156.25MHz,
312.5MHz, or 625MHz
- For 10GE optical: 20.14MHz, 40.28MHz, 80.56MHz, 161.13MHz,
322.26MHz, or 644.53MHz
3-level inputs for feedback divide ratio and output frequency range
selection
1x, 2x, 4x, 8x, 16x, and 32x outputs on QOUT
Regenerated input clock or QOUT/4 on QREG
Lock indicator
Power-down mode
LVPECL or LVDS outputs
Three modes of output frequency range
- Mode 0: QOUTrange 155.5 - 166.6MHz. QREG is a regenerated version
of the input clock.
- Mode 1: QOUT range 622 - 666.5MHz. QREG output 155.5-166.6MHz.
- Mode 2: QOUT range 622 - 666.5MHz. QREG is a regenerated version
of the input clock frequency.
Selectable loop bandwidths
Hitless switchover
Differential LVPECL, LVDS, or single-ended LVTTL input interface
2.375 - 3.465V core and I/O
Available in VFQFPN package
use replacement part:8T49N222B-dddNLGI
DESCRIPTION:
The IDT5T940 generates a high precision FEC (Forward Error Cor-
rection) or non-FEC source clock for SONET/SDH systems as well as a
source clock for Gigabit Ethernet systems. This device also has clock
regeneration capability: it creates a "clean" version of the clock input by
using the internal oscillator to square the input clock's rising and falling
edges and remove jitter. In the event that the main clock input fails, the
device automatically locks to a backup reference clock using a hitless
switchover mechanism.
This device detects loss of valid CLKIN and leaves the VCO of the PLL at
the last valid frequency while an alternate input REFIN is selected. If CLKIN
andREFINaredifferentfrequencies,themultiplicationfactorwillbeadjustedto
retainthesameoutputfrequency.
TheIDT5T940canactasatranslatorfromadifferentialLVPECL,LVDS,or
single-ended LVTTL input to LVPECL or LVDS outputs. The IDT5T940-10
has LVDS outputs and the IDT5T940-30 has LVPECL outputs.
ThethreemodesofoutputfrequencyrangearecontrolledbytheSELmode,
which is a 3-level pin. When SELmode is high or low, the QOUT is a multiplied
versionoftheinputclockwhileQREGisaregeneratedversionoftheinputclock.
WhenSELmodeismid,theQOUTisamultipliedversionoftheinputclockwhile
QREG isQOUT/4.
The IDT5T940 features a selectable loop bandwidth.
APPLICATIONS:
Terabit routers
Gigabit ethernet systems
SONET / SDH systems
Digital cross connects
Optical transceiver modules
FUNCTIONAL BLOCK DIAGRAM
PLL
CONTROL
LOGIC
LOCK,
FREQ.
DETECTOR
CLKIN
REFIN
LOCK
DIVN
DIVM
QREG
QOUT
CLK/
REF0
SELMODE
PD
PLLBW1
PLLBW0
INPUT
MUX
CLKIN
REFIN
CLK/
REF1
QREG
QOUT
MAY 2013
PRODUCT DISCONTINUATION NOTICE - LAST TIME BUY EXPIRES OCTOBER 28, 2014
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