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參數(shù)資料
| 型號： | IDT2309B-1DCG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 10/10頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK BUFFER ZD 3.3V 16-SOIC |
| 產(chǎn)品培訓模塊： | Clock Distibution and Generation 1.0 |
| 標準包裝： | 48 |
| 類型： | 零延遲緩沖器 |
| PLL： | 帶旁路 |
| 輸入： | LVTTL |
| 輸出： | LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:9 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 133MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 16-SOIC |
| 包裝： | 管件 |
| 其它名稱： | 2309B-1DCG 800-1299 800-1299-5 800-1299-ND |
9
COMMERCIALANDINDUSTRIALTEMPERATURERANGES
IDT2309B
3.3VZERODELAYCLOCKBUFFER
TYPICAL DUTYCYCLE(1)AND IDD TRENDS(2)FOR IDT2309B-1H
NOTES:
1. Duty Cycle is taken from typical chip measured at 1.4V.
2. IDD data is calculated from IDD = ICORE + nCVf, where ICORE is the unloaded current. (n = Number of outputs; C = Capacitance load per output (F); V = Supply Voltage (V);
f = Frequency (Hz))
3
3.1
3.2
3.3
3.4
3.5
3.6
VDD (V)
40
42
44
46
48
50
52
54
56
58
60
Duty Cycle vs VDD
(for 30pf loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
D
u
ty
C
y
c
le
(%
)
3
3.1
3.2
3.3
3.4
3.5
3.6
VDD (V)
40
42
44
46
48
50
52
54
56
58
60
Duty Cycle vs VDD
(for 10pF loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
20
40
60
80
100
120
140
Frequency (MHz)
40
42
44
46
48
50
52
54
56
58
60
Duty Cycle vs Frequency
(for 30pf loads over temperature - 3.3V)
-40C
0C
25C
70C
85C
D
u
ty
C
y
cl
e
(%
)
D
u
ty
C
y
c
le
(%
)
133MHz
20
40
60
80
100
120
140
Frequency (MHz)
40
42
44
46
48
50
52
54
56
58
60
Duty Cycle vs Frequency
(for 10pF loads over temperature - 3.3V)
-40C
0C
25C
70C
85C
D
u
ty
C
y
c
le
(%
)
02
4
6
8
Number of Loaded Outputs
0
20
40
60
80
100
120
140
IDD vs Number of Loaded Outputs
(for 30pf loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
ID
D
(m
A
)
02
4
6
8
Number of Loaded Outputs
0
20
40
60
80
100
120
140
IDD vs Number of Loaded Outputs
(for 10pF loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
ID
D
(m
A
)
160
相關PDF資料 |
PDF描述 |
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