IDT / ICS PCI EXPRESS JITTER ATTENUATOR
參數(shù)資料
型號: ICS9DB202CGLFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 11/13頁
文件大小: 0K
描述: IC JITTER ATTENUATOR 20-TSSOP
標準包裝: 2,500
系列: HiPerClockS™, PCI Express® (PCIe)
類型: 漂移衰減器,多路復用器
PLL:
主要目的: PCI Express(PCIe)
輸入: HCSL,LVDS,LVHSTL,LVPECL,SSTL
輸出: HCSL
電路數(shù): 1
比率 - 輸入:輸出: 1:2
差分 - 輸入:輸出: 是/是
頻率 - 最大: 140MHz
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 20-TSSOP(0.173",4.40mm 寬)
供應商設(shè)備封裝: 20-TSSOP
包裝: 帶卷 (TR)
其它名稱: 9DB202CGLFT
IDT / ICS PCI EXPRESS JITTER ATTENUATOR
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ICS9DB202CG REV B JULY 14, 2006
ICS9DB202
PCI EXPRESS JITTER ATTENUATOR
APPLICATION INFORMATION
Figure 2 shows how the differential input can be wired to accept
single ended levels. The reference voltage V_REF = V
DD
/2 is
generated by the bias resistors R1, R2 and C1. This bias circuit
should be located as close as possible to the input pin. The ratio
FIGURE 2. SINGLE ENDED SIGNAL DRIVING DIFFERENTIAL INPUT
WIRING THE DIFFERENTIAL INPUT TO ACCEPT SINGLE ENDED LEVELS
of R1 and R2 might need to be adjusted to position the V_REF in
the center of the input voltage swing. For example, if the input
clock swing is only 2.5V and V
DD
= 3.3V, V_REF should be 1.25V
and R2/R1 = 0.609.
V_REF
R1
1K
C1
0.1u
R2
1K
Single Ended Clock Input
CLK
nCLK
VDD
POWER SUPPLY FILTERING TECHNIQUES
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. The ICS9DB202 provides separate
power supplies to isolate any high switching noise from the out-
puts to the internal PLL. V
DD and VDDA should be individually con-
nected to the power supply plane through vias, and bypass ca-
pacitors should be used for each pin. To achieve optimum jitter
performance, power supply isolation is required.
Figure 1 illus-
trates how a 24
resistor along with a 10F and a .01F bypass
capacitor should be connected to each V
DDA pin. The 10 resis-
tor can also be replaced by a ferrite bead.
FIGURE 1. POWER SUPPLY FILTERING
24
V
DDA
10
F
.01
F
3.3V
.01
F
V
DD
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PDF描述
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參數(shù)描述
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