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參數(shù)資料
| 型號(hào)： | ICS97ULP877AHLF-T |
| 英文描述： | 1.8V Low-Power Wide-Range Frequency Clock Driver |
| 中文描述： | 1.8V的低功耗寬范圍頻率時(shí)鐘驅(qū)動(dòng)器 |
| 文件頁數(shù)： | 1/14頁 |
| 文件大小： | 187K |
| 代理商： | ICS97ULP877AHLF-T |
Integrated
Circuit
Systems, Inc.
ICS97ULP877A
7116—03/27/07
Block Diagram
1.8V Low-Power Wide-Range Frequency Clock Driver
Pin Configuration
40-Pin MLF
Recommended Application:
DDR2 Memory Modules / Zero Delay Board Fan Out
Provides complete DDR DIMM logic solution with
ICSSSTU32864/SSTUF32864/SSTUF32866/
SSTUA32864/SSTUA32866/SSTUA32S868/
SSTUA32S865/SSTUA32S869
Product Description/Features:
Low skew, low jitter PLL clock driver
1 to 10 differential clock distribution (SSTL_18)
Feedback pins for input to output synchronization
Spread Spectrum tolerant inputs
Auto PD when input signal is at a certain logic state
Switching Characteristics:
Period jitter: 40ps (DDR2-400/533)
30ps (DDR2-667)
Half-period jitter: 60ps (DDR2-400/533)
50ps (DDR2-667)
OUTPUT - OUTPUT skew: 40ps (DDR2-400/533)
30ps (DDR2-667)
CYCLE - CYCLE jitter 40ps
52-Ball BGA
Top View
3
CLKT0
CLKC0
GND
GND
GND
NB
VDDQ
VDDQ
VDDQ
NB
VDDQ
NB
VDDQ
VDDQ
GND
NB
GND
GND
CLKC4
CLKT4
1
2
4
5
6
A
B
C
D
E
F
G
H
J
K
CLKT1
CLKC1
CLKC2
CLKT2
CLK_INT
CLK_INC
AGND
AVDD
CLKT3
CLKC3
CLKC5
GND
NB
VDDQ
NB
NB
VDDQ
NB
GND
CLKT9
CLKT5
GND
GND
OS
VDDQ
OE
VDDQ
GND
GND
CLKC9
CLKT6
CLKC6
CLKC7
CLKT7
FB_INT
FB_INC
FB_OUTC
FB_OUTT
CLKT8
CLKC8
A
B
C
D
E
F
G
H
J
K
6
5
4
3
2
1
CLKT2
CLK_INT
GND
CLKC2
CLK_INC
V
DDQ
AV
DD
AGND
V
DDQ
V
DDQ
2
3
4
5
6
7
8
9
10
1
1
1
1
1
1
1
1
1
1
2
C
C
V
D
C
V
D
C
C
C
C
C
3
3
3
3
3
3
3
3
4
3
C
C
V
D
C
V
D
C
C
C
C
C
22
21
23
24
30
29
28
27
26
25
V
DDQ
FB_INT
OS
CLKT7
FB_INC
OE
V
DDQ
FB_OUTT
FB_OUTC
CLKC7
CLKT0
CLKC0
CLKT1
CLKC1
CLKT2
CLKC2
CLKT3
CLKC3
CLKT4
CLKC4
CLKT5
CLKC5
CLKT6
CLKC6
CLKT7
CLKC7
CLKT8
CLKC8
CLKT9
CLKC9
FB_OUTT
FB_OUTC
Powerdown
Control and
Test Logic
LD
or OE
(1)
LD , OS, or OE
OS
OE
LD
(1)
AV
DD
PLL Bypass
PLL
FB_INT
FB_INC
GND
CLK_INT
CLK_INC
NOTE:
1. The Logic Detect (LD) powers down the device when a logic LOW is
applied to both CLK_INT and CLK+INC.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS97ULP877AKLF-T | 1.8V Low-Power Wide-Range Frequency Clock Driver |
| ICS97ULPA877A | 1.8V Low-Power Wide-Range Frequency Clock Driver |
| ICS97ULPA877AH-T | 1.8V Low-Power Wide-Range Frequency Clock Driver |
| ICS97ULPA877AK-T | 1.8V Low-Power Wide-Range Frequency Clock Driver |
| ICS97ULPA877LF-T | 1.8V Low-Power Wide-Range Frequency Clock Driver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ICS97ULP877BHLFT | 功能描述:IC CLOCK DRIVER 1.8V LP 52-BGA RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時(shí)鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時(shí)鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件 |
| ICS97ULP877BHT | 功能描述:IC CLOCK DRIVER 1.8V LP 52-BGA RoHS:否 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:1,500 系列:- 類型:時(shí)鐘緩沖器/驅(qū)動(dòng)器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT |
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