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參數(shù)資料
| 型號： | ICS95V857CHLF-T |
| 英文描述： | 2.5V Wide Range Frequency Clock Driver (45MHz - 233MHz) |
| 中文描述： | 2.5V的寬量程頻率時鐘驅(qū)動器（45MHz - 233MHz） |
| 文件頁數(shù)： | 6/13頁 |
| 文件大?。?/td> | 148K |
| 代理商： | ICS95V857CHLF-T |
6
ICS95V857C
1190A—12/16/05
Notes:
1.
2.
Refers to transition on noninverting output in PLL bypass mode.
While the pulse skew is almost constant over frequency, the duty cycle error
increases at higher frequencies. This is due to the formula: duty cycle=t
wH
/t
c
, where
the cycle (t
c
) decreases as the frequency goes up.
Switching characteristics guaranteed for application frequency range.
Static phase offset shifted by design.
3.
4.
Timing Requirements
T
A
= 0 - 85°C; Supply Voltage A
VDD
, V
DD
= 2.5 V +/- 0.2V (unless otherwise stated)
PARAMETER
SYMBOL
Max clock frequency
freq
op
Application Frequency
Range
Input clock duty cycle
d
tin
CONDITIONS
MIN
45
MAX
233
UNITS
MHz
2.5V+0.2V @ 25
o
C
freq
App
2.5V+0.2V @ 25
o
C
95
220
MHz
40
60
%
CLK stabilization
T
STAB
15
μs
Switching Characteristics (see note 3)
PARAMETER
Low-to high level
propagation delay time
High-to low level propagation
delay time
Output enable time
Output disable time
Period jitter
Half-period jitter
Input clock slew rate
Output clock slew rate
Cycle to Cycle Jitter
1
Static Phase Offset
Output to Output Skew
SYMBOL
CONDITION
MIN
TYP
MAX
UNITS
t
PLH1
CLK_IN to any output
3.5
ns
t
PLL1
CLK_IN to any output
3.5
ns
t
EN
tdis
T
jit (per)
t(jit_hper)
t
sl(i)
t
sl(o)
T
cyc
-T
cyc
t
(static phase offset)4
T
skew
PD# to any output
PD# to any output
100MHz to 200MHz
100MHz to 200MHz
3
3
ns
ns
ps
ps
V/ns
V/ns
ps
ps
ps
-30
-75
1
1
-50
-50
30
75
4
2
50
50
40
100MHz to 200MHz
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS95V857CKLF-T | 2.5V Wide Range Frequency Clock Driver (45MHz - 233MHz) |
| ICS95V857CLLF-T | 2.5V Wide Range Frequency Clock Driver (45MHz - 233MHz) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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