參數(shù)資料
型號： ICS95V842
英文描述： DDR Phase Lock Loop Clock Driver (60MHz - 220MHz)
中文描述： 復(fù)員鎖相環(huán)時鐘驅(qū)動器（60MHz時- 220MHz）
文件頁數(shù)： 1/9頁
文件大?。?/td> 83K
代理商： ICS95V842
Integrated
Circuit
Systems, Inc.
ICS95V842
0830A—09/10/04
Block Diagram
DDR Phase Lock Loop Clock Driver (60MHz - 220MHz)
Pin Configuration
Recommended Application:
1:2 DDRI Clock Driver
Product Description/Features:
Low skew, low jitter PLL clock driver
Feedback pins for input to output synchronization
Spread Spectrum tolerant inputs
With bypass mode mux
Operating frequency 60 to 220 MHz
Switching Characteristics:
CYCLE - CYCLE jitter: <75ps
OUTPUT - OUTPUT skew: <60ps
Period jitter: ±75ps
Half-Period jitter: ±75ps
Functionality
S
T
T
U
N
P
N
I
K
L
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I
S
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H
L
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O
VDD2.5 1
DDRT0 2
DDRC0 3
GND 4
CLK_INT 5
CLK_INC 6
AVDD 7
AGND 8
16 GND
15 DDRC1
14 DDRT1
13 VDD2.5
12 FB_INC
11 FB_INT
10 FB_OUTT
9 FB_OUTC
16 pin SSOP
I
PLL
FB_INT
FB_INC
CLK_INC
CLK_INT
FB_OUTT
FB_OUTC
DDRT (1:0)
DDRC(1:0)
AVDD
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PDF描述
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參數(shù)描述
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