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參數(shù)資料
| 型號(hào)： | ICS952906AFLFT |
| 英文描述： | Programmable Timing Control Hub for Next Gen P4⑩ processor |
| 中文描述： | 可編程定時(shí)控制中心，為下一代的處理器?、?/td> |
| 文件頁(yè)數(shù)： | 16/23頁(yè) |
| 文件大小： | 315K |
| 代理商： | ICS952906AFLFT |
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16
Integrated
Circuit
Systems, Inc.
ICS952906A
1236A—08/06/07
Absolute Maximum Ratings
Core Operating Voltage . . . . . . . . . . . . . . . . . . . 4.6 V
I/O Operating Voltage . . . . . . . . . . . . . . . . . . . . . 3.6V
Lo gic Inputs . . . . . . . . . . . . . . . . . . . . . . . . . . . . GND –0.5 V to V
DD
+ 0.5 V
Ambient Operating Temperature . . . . . . . . . . . . 0°C to +70°C
Storage Temperature . . . . . . . . . . . . . . . . . . . . . –65°C to +150°C
Case Temperature . . . . . . . . . . . . . . . . . . . . . . . . 115°C
Stresses above those listed under Absolute Maximum Ratings may cause permanent damage to the device. These ratings are
stress specifications only and functional operation of the device at these or any other conditions above those listed in the
operational sections of the specifications is not implied. Exposure to absolute maximum rating conditions for extended
periods may affect product reliability.
Electrical Characteristics - Input/Supply/Common Output Parameters
T
A
= 0 - 70°C; Supply Voltage V
DD
= 3.3 V +/-5%
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS NOTES
Input High Voltage
Input MID Voltage
Input Low Voltage
Input High Current
V
IH
V
MID
V
IL
I
IH
3.3V +/-5%
3.3V +/-5%
3.3V +/-5%
V
IN
= V
DD
2
1
V
DD
+ 0.3
1.8
0.8
5
V
V
V
uA
V
SS
-0.3
-5
I
IL1
V
IN
= 0 V; Inputs with no pull-
up resistors
-5
uA
I
IL2
V
IN
= 0 V; Inputs with pull-up
resistors
-200
uA
Operating Supply Current
I
DD3.3OP
Full Active, C
L
= Full load;
350
mA
all diff pairs driven
all differential pairs tri-stated
V
DD
= 3.3 V
35
12
mA
mA
MHz
nH
pF
pF
pF
Input Frequency
3
Pin Inductance
1
F
i
L
pin
C
IN
C
OUT
C
INX
14.31818
3
1
1
1
1
7
5
6
5
Logic Inputs
Output pin capacitance
X1 & X2 pins
From VDD Power-Up or de-
assertion of PD# to 1st clock.
Triangular Modulation
Clk Stabilization
1,2
T
STAB
1.8
ms
1,2
Modulation Frequency
30
33
kHz
1
1
Guaranteed by design, not 100% tested in production.
2
See timing diagrams for timing requirements.
3
Input frequency should be measured at the REF output pin and tuned to ideal 14.31818MHz to meet
ppm frequency accuracy on PLL outputs.
I
DD3.3PD
Input Capacitance
1
Input Low Current
Powerdown Current
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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