2C Table: Output Control Regi" />
參數(shù)資料
型號： ICS951402AF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 22/23頁
文件大?。?/td> 0K
描述： IC TIMING CTRL HUB P4 48-SSOP
標準包裝： 30
系列： TCH™
類型： 時鐘/頻率發(fā)生器，多路復(fù)用器
PLL： 是
主要目的： Intel CPU，Timing Control Hub?
輸入： 晶體
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:19
差分 - 輸入:輸出： 無/是
頻率 - 最大： 210MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 48-BSSOP（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 48-SSOP
包裝： 管件
其它名稱： 951402AF
8
Integrated
Circuit
Systems, Inc.
ICS951402
Advance Information
0660—05/05/05
I
2C Table: Output Control Register
Byte 6
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
-
CPU_STOP#
CPU Stop Status
RW
1
Bit 6
-
PD#
PD# Status
RW
See Table 1:
Truth Table on page 3
1
Bit 5
-
PCI_F0
Free-run Control
RW
Free
Not free
0
Bit 4
-
PCI_F1
Free-run Control
RW
Free
Not free
0
Bit 3
-
CPUT/C_0
Free-run Control
RW
Free
Not free
1
Bit 2
-
CPUT/C_1
Free-run Control
RW
Free
Not free
1
Bit 1
40,39
CPUT/C_0
Output Control
RW
Disable
Enable
1
Bit 0
44,43
CPUT/C_1
Output Control
RW
Disable
Enable
1
I
2C Table: Output Control Register
Byte 7
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
15
PCICLK_F1
Output Control
RW
Disable
Enable
1
Bit 6
14
PCICLK_F0
Output Control
RW
Disable
Enable
1
Bit 5
23
PCICLK5
Output Control
RW
Disable
Enable
1
Bit 4
22
PCICLK4
Output Control
RW
Disable
Enable
1
Bit 3
21
PCICLK3
Output Control
RW
Disable
Enable
1
Bit 2
20
PCICLK2
Output Control
RW
Disable
Enable
1
Bit 1
17
PCICLK1
Output Control
RW
Disable
Enable
1
Bit 0
16
PCICLK0
Output Control
RW
Disable
Enable
1
I
2C Table: Byte Count Register
Byte 8
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
-
BC7
RW
-
0
Bit 6
-
BC6
RW
-
0
Bit 5
-
BC5
RW
-
0
Bit 4
-
BC4
RW
-
0
Bit 3
-
BC3
RW
-
1
Bit 2
-
BC2
RW
-
1
Bit 1
-
BC1
RW
-
1
Bit 0
-
BC0
Writing to this
register will configure
how many bytes will
be read back, default
is 0F = 15 bytes.
RW
-
1
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