參數(shù)資料
型號(hào)： ICS950227YFT
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘產(chǎn)生/分配
英文描述： 133.33 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝： 0.300 INCH, MO-118, SSOP-56
文件頁(yè)數(shù)： 14/17頁(yè)
文件大小： 128K
代理商： ICS950227YFT
6
Integrated
Circuit
Systems, Inc.
ICS950227
0641D—07/03/03
I
2C Table: Output Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
RESERVED
-
0
Bit 6
RESERVED
`
-
0
Bit 5
3V66_0
Output Control
RW
Disable
Enable
1
Bit 4
3V66_1/VHC_CLK
Output Control
RW
Disable
Enable
1
Bit 3
3V66_5
Output Control
RW
Disable
Enable
1
Bit 2
3V66_4
Output Control
RW
Disable
Enable
1
Bit 1
3V66_3
Output Control
RW
Disable
Enable
1
Bit 0
3V66_2
Output Control
RW
Disable
Enable
1
I
2C Table: Output Control and Fix Frequecy Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
RESERVED
-
0
Bit 6
RESERVED
-
0
Bit 5
RESERVED
-
0
Bit 4
RESERVED
-
0
Bit 3
RW
0
Bit 2
RW
0
Bit 1
RW
0
Bit 0
RW
0
I
2C Table: Vendor & Revision ID Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
RID3
R
-
1
Bit 6
RID2
R
-
1
Bit 5
RID1
R
-
1
Bit 4
RID0
R
-
1
Bit 3
VID3
R
-
1
Bit 2
VID2
R
-
1
Bit 1
VID1
R
-
1
Bit 0
VID0
R
-
1
I
2C Table: DEVICE ID
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
R-
-
0
Bit 6
R-
-
0
Bit 5
R-
-
0
Bit 4
R-
-
0
Bit 3
R-
-
0
Bit 2
R-
-
0
Bit 1
R-
-
0
Bit 0
R-
-
1
Byte 7
-
Byte 6
-
REVISION ID
-
39
48MHz_USB
USB EDGE RATE
CONTROL
00= MEDIUM (DEFAULT)
01= LOW
10= HIGH
Byte 5
22
24
23
33
35
Byte 4
-
21
-
38
00= MEDIUM (DEFAULT)
10= LOW
01= HIGH
48MHz_DOT
DOT CLOCK EDGE
RATE CONTROL
VENDOR ID
相關(guān)PDF資料
PDF描述
ICS950402YFT-LF 300 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
ICS950405YF-T 300 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
ICS950410YF-T 300 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
ICS950602YFT 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
ICS950602YFLFT 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
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參數(shù)描述
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ICS950402YFLF-T 制造商:ICS 制造商全稱:ICS 功能描述:AMD - K8 System Clock Chip
ICS950402YGLF-T 制造商:ICS 制造商全稱:ICS 功能描述:AMD - K8 System Clock Chip
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