參數(shù)資料
型號(hào)： ICS94222
廠商： Electronic Theatre Controls, Inc.
英文描述： Programmable System Frequency Generator for PII/III⑩
中文描述： 可編程系統(tǒng)頻率發(fā)生器有價(jià)證券/三⑩
文件頁(yè)數(shù)： 1/19頁(yè)
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代理商： ICS94222
Integrated
Circuit
Systems, Inc.
ICS94222
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94222 Rev - 5/10/01
Advance Information
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Pin Configuration
Recommended Application:
BX, Appollo Pro 133 type of chip set.
Output Features:
3 - CPUs @2.5V, up to 166MHz.
17 - SDRAM @ 3.3V, up to 166MHz.
7 - PCI @3.3V
2 - IOAPIC @ 2.5V
1 - 48MHz, @3.3V fixed.
1 - 24MHz @ 3.3V
2 - REF @3.3V, 14.318MHz.
Features:
Programmable ouput frequency.
Programmable ouput rise/fall time.
Programmable PCI_F and PCICLK skew.
Spread spectrum for EMI control typically by 7dB to 8dB,
with programmable spread percentage.
Watchdog timer technology to reset system
if over-clocking causes malfunction.
Uses external 14.318MHz crystal.
FS pins for frequency select
Key Specifications:
CPU – CPU: <175ps
SDRAM - SDRAM: <500ps
PCI – PCI: <500ps
CPU-SDRAM: <500ps
CPU(early)-PCI: Min=1.0ns, Typ=2.0ns, Max=4.0ns
Programmable System Frequency Generator for P
II
/
III
Block Diagram
Functionality
56-Pin SSOP
* Internal Pull-up Resistor of 240K to 3.3V on indicated inputs
AVDD
*FS2/REF1
*PCI_STOP#/REF0
GND
X1
X2
VDD
*MODE/PCICLK_F
*FS3/PCICLK0
GND
VDD
BUFFERIN
SDRAM11
SDRAM10
VDD
SDRAM9
SDRAM8
GND
SDRAM15
SDRAM14
GND
SDATA
SCLK
PCICLK1
PCICLK2
PCICLK3
PCICLK4
PCICLK5
VDDL
IOAPIC0
IOAPIC_F
GND
CPUCLK_F
CPUCLK0
VDDL
CPUCLK1
GND
CLK_STOP*
SDRAM_F
VDDSDR
SDRAM0
SDRAM1
GND
SDRAM2
SDRAM3
SDRAM4
SDRAM5
VDD
SDRAM6
SDRAM7
GND
SDRAM12
SDRAM13
AVDD48
24MHz/FS0*
48MHz/FSI*
1
I
1
2
3
4
5
6
7
8
9
10
11
12
13
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15
16
17
18
19
20
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24
25
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27
28
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
3
S
F
2
S
F
1
S
F
0
S
F
U
)
H
0
0
8
0
7
3
8
9
6
0
0
1
0
1
1
0
6
7
0
1
0
2
1
9
1
1
9
0
1
0
0
1
0
4
1
0
5
1
0
2
1
9
3
1
P
C
M
(
K
L
)
0
0
5
5
3
4
1
7
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3
6
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0
0
0
5
C
H
I
C
M
(
0
4
5
3
6
4
4
3
3
3
3
3
0
3
5
3
0
4
3
3
6
3
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3
0
3
5
3
0
3
2
3
P
0
0
0
0
0
0
0
0
1
1
1
1
1
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1
0
1
0
1
0
1
1
0
9
9
0
0
0
0
CLK_STOP#
PCI_STOP#
PLL2
PLL1
Spread
Spectrum
48MHz
IOAPIC0
CPUCLK (1:0)
CPUCLK_F
IOAPIC_F
SDRAM (15:0)
SDRAM_F
PCICLK (5:0)
PCICLK_F
X1
X2
XTAL
OSC
PCI
CLOCK
DIVDER
STOP
STOP
÷2
STOP
STOP
POR
SDATA
SCLK
FS (3:0)
MODE
Control
Logic
Config.
Reg.
REF [1:0]
24MHz
LATCH
1
2
16
6
BUFFERIN
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ICT-xxx TRANSIENT ABSORPTION ZENER
ICT-12C TRANSIENT ABSORPTION ZENER
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