參數(shù)資料
型號： ICS932S208YFLF-T
英文描述： Programmable Timing Control Hub⑩ for Next Gen P4⑩ processor
中文描述： 可編程定時控制中心⑩處理器的下一代?、?/td>
文件頁數(shù)： 7/14頁
文件大?。?/td> 105K
代理商： ICS932S208YFLF-T
7
ICS932S202
0600A—08/04/03
Group Offset
Group
CPU to 3V66
CPU to PCI
CPU to IOAPIC
Note: 1. All offsets are to be measured at rising edges.
Offset
Measurement Loads
CPU @ 20pF, 3V66 @ 30pF
CPU @ 20pF, PCI @ 30pF
Measure Points
CPU @1.25V, 3V66 @ 1.5V
CPU @ 1.25V, PCI @ 1.5V
0.8 to 1.8ns CPU leads
0 to 1.5ns CPU leads
1.5 to 4.0ns CPU leads CPU @ 20pF, IOAPIC @ 20pF CPU @ 1.25V, IOAPIC @ 1.25V
Electrical Characteristics - CPUCLK
T
A
= 0 - 70°C; V
DD
= 3.3 V +/-5%, V
DDL
= 2.5V +/- 5 %; C
L
= 20 pF (unless otherwise stated).
PARAMETER
SYMBOL
Output High Voltage
V
OH2B
I
OH
= -12 mA
Output Low Voltage
V
OL2B
I
OL
= 12 mA
Output High Current
I
OH2B
V
OH
= 1.7 V
Output Low Current
I
OL2B
V
OL
= 0.7 V
Rise Time
t
r2B
V
OL
= 0.4 V, V
OH
= 2.0 V
Fall Time
t
f2B
V
OH
= 2.0 V, V
OL
= 0.4 V
Duty Cycle
d
t2B
V
T
= 1.25 V
Cpu0:1
V
T
=1.25 to 1.5V @ all frequency
Skew
CPU0:3
VT=1.25 to 1.5V @ 66MHz
VT=1.25 to 1.5V @ 100MHz
VT=1.25 to 1.5V @ 133MHz
VT=1.25 to 1.5V @ 200MHz
Jitter, Cycle-to-cycle
t
jcyc-cyc2B
V
T
= 1.25 V
1
Guaranteed by design, not 100% tested in production.
CONDITIONS
MIN
2
TYP
2.3
0.3
-35
26
0.73
0.76
50.6
-2
140
165
155
70
108
MAX
UNITS
V
V
mA
mA
ns
ns
%
ps
ps
ps
ps
ps
ps
0.4
-19
19
0.4
0.4
45
1
0.9
0.9
55
175
175
175
175
175
250
1
1
1
相關PDF資料
PDF描述
ICS932S208YGLF-T Programmable Timing Control Hub⑩ for Next Gen P4⑩ processor
ICS932S203 Frequency Generator with 133MHz Differential CPU Clocks
ICS9341 133MHz Clock Generator and Integrated Buffer for PowerPC⑩
ICS9341yF 133MHz Clock Generator and Integrated Buffer for PowerPC⑩
ICS9342yF-T 133MHz Clock Generator and Integrated Buffer for PowerPC⑩
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參數(shù)描述
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