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參數(shù)資料
| 型號： | ICS87949AYT |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | LOW SKEW CLOCK DRIVER, 15 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, MS-026, LQFP-52 |
| 文件頁數(shù)： | 1/11頁 |
| 文件大?。?/td> | 141K |
| 代理商： | ICS87949AYT |
87949AY
www.icst.com/products/hiperclocks.html
REV. A JANUARY 2, 2002
1
Integrated
Circuit
Systems, Inc.
ICS87949
LOW SKEW
÷1, ÷2
CLOCK GENERATOR
PRELIMINARY
GENERAL DESCRIPTION
The ICS87949 is a low skew, ÷1, ÷2 Clock Gen-
erator and a member of the HiPerClockS family
of High Performance Clock Solutions from ICS.
The ICS87949 has selectable single ended clock
or LVPECL clock inputs. The single ended clock
input accepts LVCMOS or LVTTL input levels. The PCLK,
nPCLK pair can accept LVPECL, CML, or SSTL input levels.
The low impedance LVCMOS outputs are designed to drive
50
series or parallel terminated transmission lines. The ef-
fective fanout can be increased from 15 to 30 by utilizing the
ability of the outputs to drive two series terminated lines.
The divide select inputs, DIV_SELx, control the output fre-
quency of each bank. The outputs can be utilized in the ÷1,
÷2 or a combination of ÷1 and ÷2 modes. The master reset
input, MR/nOE, resets the internal frequency dividers and also
controls the active and high impedance states of all outputs.
The ICS87949 is characterized at 3.3V core/3.3V output. Guar-
anteed output and part-to-part skew characteristics make the
ICS87949 ideal for those clock distribution applications demand-
ing well defined performance and repeatability.
FEATURES
15 single ended LVCMOS outputs, 7
typical output
impedance
Selectable LVCMOS or LVPECL clock inputs
CLK0 and CLK1 can accept the following input levels:
LVCMOS and LVTTL
PCLK, nPCLK supports the following input types:
LVPECL, CML, SSTL
Maximum input frequency: 250MHz
Output skew: 350ps (maximum)
Part-to-part skew: 2.75ns (maximum)
3.3V supply voltage
0°C to 70°C ambient operating temperature
Industrial temperature information available upon request
Pin compatible to the MPC949
BLOCK DIAGRAM
PIN ASSIGNMENT
52-Lead LQFP
10mm x 10mm x 1.4mm package body
Y Package
Top View
HiPerClockS
,&6
nc
V
DDD
QD4
GND
QD3
V
DDD
QD2
GND
QD1
V
DDD
QD0
GND
nc
MR/nOE
CLK_SEL
VDD
CLK0
CLK1
PCLK
nPCLK
PCLK_SEL
DIV_SELA
DIV_SELB
DIV_SELC
DIV_SELD
GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14 15 16 17 18 19 20 21 22 23 24 25 26
39
38
37
36
35
34
33
32
31
30
29
28
27
52 51 50 49 48 47 46 45 44 43 42 41 40
nc
GND
QC0
VDDC
QC1
GND
QC2
VDDC
QC3
GND
QD5
nc
V
DDB
QB2
GND
QB1
V
DDB
QB0
GND
QA1
V
DDA
QA0
GND
ICS87949
DIV_SELA
DIV_SELB
DIV_SELC
DIV_SELD
MR/nOE
QA0 - QA1
QB0 - QB2
QC0 - QC3
QD0 - QD5
CLK_SEL
CLK0
CLK1
PCLK
nPCLK
PCLK_SEL
0
1
÷1
÷2
0
1
0
1
0
1
0
1
R
0
1
The Preliminary Information presented herein represents a product in prototyping or pre-production. The noted characteristics are based on initial
product characterization. Integrated Circuit Systems, Incorporated (ICS) reserves the right to change any circuitry or specifications without notice.
相關PDF資料 |
PDF描述 |
|---|---|
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| ICS87950AY | 180 MHz, OTHER CLOCK GENERATOR, PQFP32 |
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| ICS87950BYI | 250 MHz, OTHER CLOCK GENERATOR, PQFP32 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| ICS87951AYI-147LFT | 功能描述:IC BUFFER ZD 1-9 LOW SKEW 32LQFP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:HiPerClockS™ 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
| ICS87951AYILF | 功能描述:IC CLK ZDB 1:9 180MHZ 32LQFP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:HiPerClockS™ 標準包裝:2,000 系列:- 類型:PLL 頻率合成器 PLL:是 輸入:晶體 輸出:時鐘 電路數(shù):1 比率 - 輸入:輸出:1:1 差分 - 輸入:輸出:無/無 頻率 - 最大:1GHz 除法器/乘法器:是/無 電源電壓:4.5 V ~ 5.5 V 工作溫度:-20°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-LSSOP（0.175"，4.40mm 寬） 供應商設備封裝:16-SSOP 包裝:帶卷 (TR) 其它名稱:NJW1504V-TE1-NDNJW1504V-TE1TR |
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