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參數(shù)資料
| 型號： | ICS87604AGILFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 11/13頁 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN PCI/PCI-X 28-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | HiPerClockS™ |
| 類型： | 時鐘/頻率發(fā)生器，零延遲緩沖器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | PCI Express（PCIe） |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVCMOS，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:5 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 167.67MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-TSSOP（0.240"，6.10mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 87604AGILFT |
ICS87601AGI REVISION B APRIL 1, 2010
7
2010 Integrated Device Technology, Inc.
ICS87604I
LOW VOLTAGE/LOW SKEW, 1:4 PCI/PCI-X ZERO DELAY CLOCK GENERATOR
APPLICATION INFORMATION
POWER SUPPLY FILTERING TECHNIQUES
FIGURE 1. POWER SUPPLY FILTERING
10
Ω
V
DDA
10
μF
.01
μF
3.3V
.01
μF
V
DD
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. To achieve optimum jitter per-
formance, power supply isolation is required. The ICS87604I pro-
vides separate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
DD, VDDA, and VDDO
should be individually connected to the power supply
plane through vias, and
0.01μF bypass capacitors should be
used for each pin.
Figure 1 illustrates this for a generic V
DD pin
and also shows that V
DDA requires that an additional10Ω resistor
along with a 10F bypass capacitor be connected to the V
DDA pin.
The 10
Ω resistor can also be replaced by a ferrite bead.
INPUTS:
CRYSTAL INPUT
For applications not requiring the use of the crystal oscillator
input, both XTAL_IN and XTAL_OUT can be left floating. Though
not required, but for additional protection, a 1k
Ω resistor can be
tied from XTAL_IN to ground.
REF_CLK INPUT
For applications not requiring the use of the reference clock, it
can be left floating. Though not required, but for additional
protection, a 1k
Ω resistor can be tied from the REF_CLK to
ground.
LVCMOS CONTROL PINS
All control pins have internal pull-ups or pull-downs; additional
resistance is not required but can be added for additional
protection. A 1k
Ω resistor can be used.
RECOMMENDATIONS FOR UNUSED INPUT AND OUTPUT PINS
OUTPUTS:
LVCMOS OUTPUTS
All unused LVCMOS output can be left floating. There should be
no trace attached.
CRYSTAL INPUT INTERFACE
The ICS87604I has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown in
Figure 2 below were determined using a 25MHz, 18pF parallel
resonant crystal and were chosen to minimize the frequency ppm
error. The optimum C1 and C2 values can be slightly adjusted for
optimum frequency accuracy.
FIGURE 2. CRYSTAL INPUt INTERFACE
XTAL_IN
XTAL_OUT
X1
18pF Parallel Crystal
C1
22p
C2
22p
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