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參數(shù)資料
| 型號： | ICS8737-11 |
| 英文描述： | LOW SKEW ±1/±2 DIFFERENTIAL-TO- 3.3V LVPECL CLOCK GENERATOR |
| 中文描述： | 低偏差± 1 / ± 2差分至3.3V的LVPECL時(shí)鐘發(fā)生器 |
| 文件頁數(shù)： | 8/13頁 |
| 文件大?。?/td> | 127K |
| 代理商： | ICS8737-11 |
8737AG-11
www.icst.com/products/hiperclocks.html
REV. A JULY 13, 2001
8
ICS8737-11
L
OW
S
KEW
÷
1/
÷
2
D
IFFERENTIAL
-
TO
- 3.3V LVPECL C
LOCK
G
ENERATOR
APPLICATION INFORMATION
WIRING THE DIFFERENTIAL INPUT TO ACCEPT SINGLE ENDED LEVELS
Figure 9shows how the differential input can be wired to accept single end levels. The reference voltage V_REF ~
V
/2 is generated by the bias resistors R1, R2 and C1. This bias circuit should be located as close as possible to
the input pin. The ratio of R1 and R2 might need to be adjusted to position the V_REF in the center of the input
voltage swing. For example, if the input clock swing is only 12.5V and V
CC
= 3.3V, V_REF should be 1.25V and R2/
R1 = 0.609.
R2
1K
V
CC
CLK_IN
+
-
R1
1K
C1
0.1uF
V_REF
F
IGURE
9 - S
INGLE
E
NDED
S
IGNAL
D
RIVING
D
IFFERENTIAL
I
NPUT
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PDF描述 |
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