參數(shù)資料
型號: ICS8624
英文描述: LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER
中文描述: 低偏移,1至5差分至HSTL零延遲緩沖器
文件頁數(shù): 9/16頁
文件大小: 288K
代理商: ICS8624
8624BY
www.icst.com/products/hiperclocks.html
REV. C JUNE 15, 2004
9
Integrated
Circuit
Systems, Inc.
ICS8624
L
OW
S
KEW
, 1-
TO
-5
D
IFFERENTIAL
-
TO
-HSTL Z
ERO
D
ELAY
B
UFFER
F
IGURE
4A. ICS8624 HSTL Z
ERO
D
ELAY
B
UFFER
S
CHEMATIC
E
XAMPLE
L
AYOUT
G
UIDELINE
The schematic of the ICS8624 layout example is shown in
Figure 4A. The ICS8624 recommended PCB board layout for
this example is shown in Figure 4B. This layout example is
used as a general guideline. The layout in the actual system
0C11
(U1-16)
CSEL0
(U1-17)
Zo = 50 Ohm
SEL1
(U1-32)
R4A
50
DIV_SEL[1:0] = 01
VDD
C4
0.1uF
Zo = 50 Ohm
R9
50
VDD=3.3V
VDDO=1.8V
CLK_SEL
R4B
50
C2
0.1uF
RU5
SP
C7
0.1uF
VDDA
R2A
50
C1
0.1uF
RU3
1K
(U1-25)
(155.5 MHz)
VDD
R10
50
Zo = 50 Ohm
RD2
1K
R7
10
C16
10u
SP = Space (i.e. not intstalled)
R2B
50
Zo = 50 Ohm
Bypass capacitor located near the power pins
VDDO
P
RD4
SP
155.5 MHz
C6
0.1uF
3.3V
RU4
1K
VDD
LVHSTL_input
+
-
VDD
R8
50
(U1-24)
SEL1
RD5
1K
U1
8624
1
2
3
4
5
6
7
8
9
1
1
1
1
1
1
1
17
18
19
20
21
22
23
24
3
3
3
2
2
2
2
2
SEL0
SEL1
CLK0
CLK1
nCLK2
CLK_SEL
V
n
F
G
G
n
Q
VVnQ1
Q1
nQ2
nQ2
Q3
VDDO
V
P
V
G
G
Q
n
V
VDDO
RU2
SP
RD3
SP
(U1-9)
3.3V PECL Driver
C5
0.1uF
will depend on the selected component types, the density of
the components, the density of the traces, and the stack up
of the P.C. board.
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參數(shù)描述
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ICS8633AF-01LF 功能描述:IC BUFFER ZD 2-3 LVPECL 28-SSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器,PLL,頻率合成器 系列:HiPerClockS™ 標(biāo)準(zhǔn)包裝:1,000 系列:Precision Edge® 類型:時鐘/頻率合成器 PLL:無 輸入:CML,PECL 輸出:CML 電路數(shù):1 比率 - 輸入:輸出:2:1 差分 - 輸入:輸出:是/是 頻率 - 最大:10.7GHz 除法器/乘法器:無/無 電源電壓:2.375 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-VFQFN 裸露焊盤,16-MLF? 供應(yīng)商設(shè)備封裝:16-MLF?(3x3) 包裝:帶卷 (TR) 其它名稱:SY58052UMGTRSY58052UMGTR-ND