參數(shù)資料
型號(hào)： ICS858020AKLFT
元件分類(lèi)： 時(shí)鐘及定時(shí)
英文描述： 858020 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC16
封裝： ROHS COMPLIANT, 3 X 3 MM, 0.95 MM HEIGHT, MO-220, VFQFN-16
文件頁(yè)數(shù)： 1/13頁(yè)
文件大小： 216K
代理商： ICS858020AKLFT
858020AK
www.icst.com/products/hiperclocks.html
REV. A APRIL 24, 2006
1
Integrated
Circuit
Systems, Inc.
ICS858020
LOW SKEW, 1-TO-4
DIFFERENTIAL-TO-CML FANOUT BUFFER
GENERAL DESCRIPTION
The ICS858020 is a high speed 1-to-4 Differential-
to-CML Fanout Buffer and is a member of the
HiPerClockSfamily of high performance clock
solutions from ICS. The ICS858020 is optimized
for high speed and very low output skew, making
it suitable for use in demanding applications such as SONET,
1 Gigabit and 10 Gigabit Ethernet, and Fibre Channel. The
internally terminated differential input and VREF_AC pin allow
other differential signal families such as LVDS, LVHSTL and
CML to be easily interfaced to the input with minimal use of
external components. The ICS858020 is packaged in a small
3mm x 3mm 16-pin VFQFN package which makes it ideal for
use in space-constrained applications.
FEATURES
Four differential CML outputs
One LVPECL differential clock input
IN, nIN pair can accept the following differential input
levels: LVPECL, LVDS, CML, SSTL
Maximum output frequency: 3.2GHz
Output skew: 30ps (maximum)
Part-to-part skew: 225ps (maximum)
Additive phase jitter, RMS: <0.03ps (typical)
Propagation delay: 600ps (maximum)
Operating voltage supply range:
V
CC = 2.375V to 3.63V, VEE = 0V
-40°C to 85°C ambient operating temperature
Available in both standard and lead-free RoHS compliant
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
HiPerClockS
ICS
IN
V
T
nIN
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
V
REF_AC
ICS858020
16-Lead VFQFN
3mm x 3mm x 0.95 package body
K Package
Top View
IN
VT
VREF_AC
nIN
Q1
nQ1
Q2
nQ2
V
EE
nQ3
Q3
V
CC
V
EE
Q0
nQ
0
V
CC
1
2
3
4
12
11
10
9
5
6
7
8
16 15 14 13
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PDF描述
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參數(shù)描述
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