參數(shù)資料
型號(hào): ICS8545BGLF
元件分類: 時(shí)鐘及定時(shí)
英文描述: 8545 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
封裝: 6.50 X 4.40 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-20
文件頁(yè)數(shù): 1/12頁(yè)
文件大?。?/td> 286K
代理商: ICS8545BGLF
8545BG
www.icst.com/products/hiperclocks.html
REV. C JANUARY 17, 2006
1
Integrated
Circuit
Systems, Inc.
ICS8545
LOW SKEW, 1-TO-4
LVCMOS/LVTTL-TO-LVDS FANOUT BUFFER
GENERAL DESCRIPTION
The ICS8545 is a low skew, high performance
1-to-4 LVCMOS/LVTTL-to-LVDS Clock Fanout
Buffer and a member of the HiPerClockS fam-
ily of High Performance Clock Solutions from ICS.
Utilizing Low Voltage Differential Signaling (LVDS)
the ICS8545 provides a low power, low noise, solution for dis-
tributing clock signals over controlled impedances of 100
Ω.
The ICS8545 accepts a LVCMOS/LVTTL input level and trans-
lates it to 3.3V LVDS output levels.
Guaranteed output and part-to-part skew characteristics
make the ICS8545 ideal for those applications demanding well
defined performance and repeatability.
FEATURES
Four LVDS outputs
Two LVCMOS/LVTTL clock inputs to support redundant
or selectable frequency fanout applications
Maximum output frequency: 650MHz
Translates LVCMOS/LVTTL input signals to LVDS levels
Output skew: 40ps (maximum)
Part-to-part skew: 500ps (maximum)
Propagation delay: 3.6ns (maximum)
3.3V operating supply
0°C to 70°C ambient operating temperature
Available in both standard and lead-free RoHS compliant
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
ICS8545
20-Lead TSSOP
6.5mm x 4.4mm x 0.92mm body package
G Package
Top View
GND
CLK_EN
CLK_SEL
CLK1
nc
CLK2
nc
OE
GND
VDD
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
Q0
nQ0
VDD
Q1
nQ1
Q2
nQ2
GND
Q3
nQ3
HiPerClockS
ICS
OE
CLK1
CLK2
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
0
1
CLK_EN
CLK_SEL
nD
Q
LE
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PDF描述
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ICS8545BGLF 8545 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
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參數(shù)描述
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