參數(shù)資料
型號： ICS854058AG
英文描述： DIFFERENTIAL-TO-LVDS CLOCK MULTIPLEXER
中文描述： 差分至LVDS脈多
文件頁數(shù)： 8/12頁
文件大小： 174K
代理商： ICS854058AG
854058AG
www.icst.com/products/hiperclocks.html
REV. A APRIL 8, 2004
8
Integrated
Circuit
Systems, Inc.
ICS854058
8:1
D
IFFERENTIAL
-
TO
-LVDS C
LOCK
M
ULTIPLEXER
PRELIMINARY
LVPE CL C
LOCK
I
NPUT
I
NTERFACE
The PCLK /nPCLK accepts LVPECL, CML, SSTL and other
differential signals. Both V
and V
must meet the V
and V
input requirements. Figures 3A to 3E show inter-
face examples for the HiPerClockS PCLK/nPCLK input driven
by the most common driver types. The input interfaces sug-
gested here are examples only. If the driver is from another
vendor, use their termination recommendation. Please con-
sult with the vendor of the driver component to confirm the
driver termination requirements.
F
IGURE
3A. H
I
P
ER
C
LOCK
S PCLK/
n
PCLK I
NPUT
D
RIVEN
BY
A
CML D
RIVER
F
IGURE
3B. H
I
P
ER
C
LOCK
S PCLK/nPCLK I
NPUT
D
RIVEN
BY
AN
SSTL
IN
D
RIVER
F
IGURE
3C. H
I
P
ER
C
LOCK
S PCLK/nPCLK I
NPUT
D
RIVEN
BY
A
3.3V LVPECL D
RIVER
F
IGURE
3D. H
I
P
ER
C
LOCK
S PCLK/nPCLK I
NPUT
D
RIVEN
BY
A
3.3V LVDS D
RIVER
PCLK/nPCLK
PCLK
nPCLK
3.3V
R2
50
R1
50
3.3V
Zo = 50 Ohm
CML
3.3V
Zo = 50 Ohm
2.5V
Zo = 60 Ohm
SSTL
HiPerClockS
PCLK
nPCLK
R2
120
3.3V
R3
120
Zo = 60 Ohm
R1
120
R4
120
2.5V
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
3.3V
R3
R2
84
Zo = 50 Ohm
3.3V
R4
LVPECL
R1
84
3.3V
F
IGURE
3E. H
I
P
ER
C
LOCK
S PCLK/nPCLK I
NPUT
D
RIVEN
BY
A
3.3V LVPECL D
RIVER
WITH
AC C
OUPLE
3.3V
R5
3.3V
3.3V
PCLK/nPCLK
PCLK
nPCLK
R1
R2
R3
84
C1
C2
Zo = 50 Ohm
R4
84
Zo = 50 Ohm
R6
3.3V LVPECL
Zo = 50 Ohm
R1
100
3.3V
LVDS_Driver
Zo = 50 Ohm
Receiver
CLK
nCLK
3.3V
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