參數(shù)資料
型號: ICS854057
英文描述: 4:1 OR 2:1 LVDS CLOCK MULTIPLEXER WITH INTERNAL INPUT TERMINATION
中文描述: 4:1或2:1的LVDS脈多與內(nèi)部輸入終端
文件頁數(shù): 6/13頁
文件大?。?/td> 256K
代理商: ICS854057
854057AG
www.icst.com/products/hiperclocks.html
REV. A JULY 18, 2005
6
Integrated
Circuit
Systems, Inc.
ICS854057
4:1
OR
2:1 LVDS C
LOCK
M
ULTIPLEXER
WITH
I
NTERNAL
I
NPUT
T
ERMINATION
P
ARAMETER
M
EASUREMENT
I
NFORMATION
P
ART
-
TO
-P
ART
S
KEW
P
ROPAGATION
D
ELAY
O
UTPUT
D
UTY
C
YCLE
/P
ULSE
W
IDTH
/P
ERIOD
D
IFFERENTIAL
I
NPUT
L
EVEL
I
NPUT
S
KEW
2.5V O
UTPUT
L
OAD
AC T
EST
C
IRCUIT
V
CMR
Cross Points
V
PP
GND
PCLK0:
PCLK3
nPCLK0:
nPCLK3
V
DD
t
PD
Q
nQ
t
sk(pp)
PART 1
PART 2
Q
Q
nQ
nQ
PCLK0:
PCLK3
nPCLK0:
nPCLK3
Q
nQ
t
PW
t
PERIOD
t
PW
t
PERIOD
odc =
x 100%
SCOPE
Qx
nQx
LVDS
PO2.5V±5%
+
Float GND
-
V
DD
t
PD2
t
PD1
tsk(i) = |t
PD1
- t
PD2
|
tsk(i)
Q
nQ
PCLKx
nPCLKx
PCLKy
nPCLKy
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PDF描述
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參數(shù)描述
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