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參數(shù)資料
| 型號： | ICS851010AYLF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 9/16頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK BUFFER 1:10 250MHZ 32TQFP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:10 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | HCSL，LVDS，LVHSTL，LVPECL |
| 輸出： | HCSL |
| 頻率 - 最大： | 250MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 托盤 |
| 其它名稱： | 800-1912 |
ICS851010 Data Sheet
1-to-10, DIFFERENTIAL HCSL FANOUT BUFFER
ICS851010AY REVISION A AUGUST 2, 2010
2
2010 Integrated Device Technology, Inc.
Table 1. Pin Descriptions
Output Driver Current
The ICS851010 outputs are HCSL differential current dr ive with
the current being set with a resistor from I
REF to ground. Fo r
a single load and a 50
pc board trace, the drive current would
typically be set with a R
REF of 950 which products an IREF of 1.16mA.
The I
REF is multiplied by a current mirror to an output drive of
12*1.16mA or 13.90mA. See Figure 1 for current mirror and output
drive details.
RREF
950
RL
IREF
Figure 1. HCSL Current Mirror and Output Drive
Number
Name
Type
Description
1, 2
Q0, nQ0
Output
Differential output pair. Differential HCSL interface levels.
3, 8, 13, 14,
17, 22, 30
VDD
Power
Positive supply pins.
4, 5
Q1, nQ1
Output
Differential output pair. Differential HCSL interface levels.
6, 7
Q2, nQ2
Output
Differential output pair. Differential HCSL interface levels.
9, 25
GND
Power
Power supply ground.
10
IREF
Input
Reference current input. Used to set the output current. Connect to 950
resistor to ground.
11, 12
Q3, nQ3
Output
Differential output pair. Differential HCSL interface levels.
15, 16
Q4, nQ4
Output
Differential output pair. Differential HCSL interface levels.
18, 19
Q5, nQ5
Output
Differential output pair. Differential HCSL interface levels.
20, 21
Q6, nQ6
Output
Differential output pair. Differential HCSL interface levels.
23, 24
Q7, nQ7
Output
Differential output pair. Differential HCSL interface levels.
26
CLK
Input
Non-inverting differential input.
27
nCLK
Input
Inverting differential clock input.
28, 29
Q8, nQ8
Output
Differential output pair. Differential HCSL interface levels.
31, 32
Q9, nQ9
Output
Differential output pair. Differential HCSL interface levels.
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參數(shù)描述 |
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