參數(shù)資料
型號: ICS84427CMLF
元件分類: 時鐘產(chǎn)生/分配
英文描述: 625 MHz, OTHER CLOCK GENERATOR, PDSO24
封裝: 7.50 X 15.33 MM, 2.30 MM HEIGHT, ROHS COMPLIANT, MS-013, MO-119, SOIC-24
文件頁數(shù): 11/13頁
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代理商: ICS84427CMLF
84427CM
www.icst.com/products/hiperclocks.html
REV. D NOVEMBER 30, 2005
7
Integrated
Circuit
Systems, Inc.
ICS84427
CRYSTAL-TO-LVDS
INTEGRATED FREQUENCY SYNTHESIZER/FANOUT BUFFER
PRELIMINARY
APPLICATION INFORMATION
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. The ICS84427 provides sepa-
rate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
DD and VDDA should
be individually connected to the power supply plane through
vias, and bypass capacitors should be used for each pin. To
achieve optimum jitter performance, power supply isolation is
required. Figure 1 illustrates how a 24
Ω resistor along with a
10
μF and a .01μF bypass capacitor should be connected to
each V
DDA pin.
POWER SUPPLY FILTERING TECHNIQUES
FIGURE 1. POWER SUPPLY FILTERING
24
Ω
V
DDA
10
μF
.01
μF
3.3V
.01
μF
V
DD
CRYSTAL INPUT INTERFACE
The ICS84427 has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown
in Figure 2 below were determined using a 25MHz, 18pF
Figure 2. CRYSTAL INPUt INTERFACE
parallel resonant crystal and were chosen to minimize the
ppm error. The optimum C1 and C2 values can be slightly
adjusted for different board layouts.
C1
18p
X1
18pF Parallel Crystal
C2
22p
XTAL_IN
XTAL_OUT
相關(guān)PDF資料
PDF描述
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ICS8442AYILF 700 MHz, OTHER CLOCK GENERATOR, PQFP32
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ICS8501BY LOW SKEW CLOCK DRIVER, 16 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP48
ICS8501BYT LOW SKEW CLOCK DRIVER, 16 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP48
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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