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參數(shù)資料
| 型號： | ICS844204BK-245LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 12/13頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK SYNTHESIZER 4LVDS 32VFQFN |
| 標準包裝： | 2,500 |
| 系列： | HiPerClockS™, PCI Express® (PCIe) |
| 類型： | 時鐘/頻率合成器，扇出緩沖器（分配），擴展頻譜時鐘發(fā)生器 |
| PLL： | 是 |
| 主要目的： | PCI Express（PCIe） |
| 輸入： | 晶體 |
| 輸出： | LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:4 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 250MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 32-VFQFN（5x5） |
| 包裝： | 帶卷 (TR) |
IDT / ICS LVDS PCI EXPRESS CLOCK SYNTHESIZER
8
ICS844204BK-245 REV. A JULY 9, 2007
ICS844204-245
CRYSTAL-TO-LVDS PCI EXPRESS CLOCK SYNTHESIZER W/SPREAD SPECTRUM
PRELIMINARY
3.3V LVDS DRIVER TERMINATION
A general LVDS interface is shown in Figure 5. In a 100
Ω
differential transmission line environment, LVDS drivers require
a matched load termination of 100
Ω across near the receiver
FIGURE 5. TYPICAL LVDS DRIVER TERMINATION
input. For a multiple LVDS outputs buffer, if only partial outputs
are used, it is recommended to terminate the un-used outputs.
R1
100
3.3V
100 Ohm Differential Transmission Line
3.3V
+
-
LVDS
相關PDF資料 |
PDF描述 |
|---|---|
| VE-2NZ-MW-S | CONVERTER MOD DC/DC 2V 40W |
| VE-23P-MY-S | CONVERTER MOD DC/DC 13.8V 50W |
| VE-23N-MY-S | CONVERTER MOD DC/DC 18.5V 50W |
| VE-23M-MY-S | CONVERTER MOD DC/DC 10V 50W |
| VE-23F-MY-S | CONVERTER MOD DC/DC 72V 50W |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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