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參數(shù)資料
| 型號： | ICS844008BYI-15LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 13/14頁 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER 8LVDS 32-LQFP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 時(shí)鐘/頻率合成器，扇出分配 |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:8 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 125MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 844008BYI-15LFT |
IDT / ICS LVDS FREQUENCY SYNTHESIZER
8
ICS844008BYI-15 REV. A AUGUST 14, 2007
ICS844008I-15
FEMTOCLOCKS CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
CRYSTAL INPUT INTERFACE
The ICS844008I-15 has been characterized with an 18pF
parallel resonant crystals. The capacitor values shown in
FIGURE 2. CRYSTAL INPUt INTERFACE
Figure 2 below were determined using a 25MHz parallel
resonant crystal and were chosen to minimize the ppm error.
APPLICATION INFORMATION
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. The ICS844008I-15 provides
separate power supplies to isolate any high switching noise
from the outputs to the internal PLL. V
DD and VDDA
should be
individually connected to the power supply plane through vias,
and bypass capacitors should be used for each pin. To achieve
optimum jitter performance, power supply isolation is required.
Figure 1 illustrates how a 10
Ω resistor along with a 10F and
a 0.01
μF bypass capacitor should be connected to each V
DDA.
POWER SUPPLY FILTERING TECHNIQUES
FIGURE 1. POWER SUPPLY FILTERING
10
Ω
V
DDA
10
μF
.01
μF
3.3V
.01
μF
V
DD
C1
27p
X1
18pF Parallel Crystal
C2
27p
XTAL_OUT
XTAL_IN
INPUTS:
LVCMOS CONTROL PINS:
All control pins have internal pull-ups or pull-downs; additional
resistance is not required but can be added for additional
protection. A 1k
Ω resistor can be used.
RECOMMENDATIONS FOR UNUSED INPUT AND OUTPUT PINS
OUTPUTS:
LVDS
All unused LVDS outputs should be terminated with 100
Ω resistor
between the differential pair.
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PDF描述 |
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參數(shù)描述 |
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