參數(shù)資料
型號： ICS844004AK-104LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 9/16頁
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描述： IC SYNTHESIZER LVDS 32-VFQFPN
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™, FemtoClock™
類型： 頻率合成器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 2:4
差分 - 輸入:輸出： 無/是
頻率 - 最大： 226.66MHz
除法器/乘法器： 是/無
電源電壓： 2.375 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 32-VFQFPN 裸露焊盤（4x4）
包裝： 帶卷 (TR)
其它名稱： 844004AK-104LFT
ICS844004-104
FEMTOCLOCKCRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
IDT / ICS LVDS FREQUENCY SYNTHESIZER
2
ICS844004AK-104 REV. A SEPTEMBER 15, 2008
Table 1. Pin Descriptions
NOTE: Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 2
Q0, nQ0
Output
Differential output pair. LVDS interface levels.
3
MR
Input
Pulldown
Active HIGH Master Reset. When logic HIGH, the internal dividers are reset
causing the true outputs Qx to go low and the inverted outputs nQx
to go high. When logic LOW, the internal dividers and the outputs are enabled.
LVCMOS/LVTTL interface levels.
4
nPLL_SEL
Input
Pulldown
Selects between the PLL and REF_CLK as input to the dividers. When LOW,
selects PLL (PLL Enable). When HIGH, deselects the reference clock (PLL
Bypass). LVCMOS/LVTTL interface levels.
5, 6, 7, 8, 15,
16, 20, 21,
28, 29
nc
Unused
No connect.
9VDDA
Power
Analog supply pin.
10,
12
F_SEL0,
F_SEL1
Input
Pulldown
Frequency select pin. LVCMOS/LVTTL interface levels.
11
VDD
Power
Core supply pin.
13,
14
XTAL_OUT
XTAL_IN
Input
Crystal oscillator interface. XTAL_IN is the input, XTAL_OUT is the output.
17, 22
GND
Power
Power supply ground.
18
REF_CLK
Input
Pulldown
Single-ended reference clock input. LVCMOS/LVTTL interface levels.
19
nXTAL_SEL
Input
Pulldown
Selects between crystal or REF_CLK inputs as the PLL Reference source.
Selects XTAL inputs when LOW. Selects REF_CLK when HIGH.
LVCMOS/LVTTL interface levels.
23, 24
nQ3, Q3
Output
Differential output pair. LVDS interface levels.
25, 32
VDDO
Power
Output supply pins.
26, 27
Q2, nQ2
Output
Differential output pair. LVDS interface levels.
30, 31
nQ1, Q1
Output
Differential output pair. LVDS interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
RPULLDOWN Input Pulldown Resistor
51
k
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PDF描述
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