FEMTOCLOCKTM CRYSTAL-TO- 3.3V LVPECL FREQUENCY SYNTHESIZER IDT / ICS 3" />
參數(shù)資料
型號(hào)： ICS843252AGLF
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 13/16頁(yè)
文件大?。?/td> 0K
描述： IC SYNTHESIZER LVPECL 16-TSSOP
標(biāo)準(zhǔn)包裝： 96
系列： HiPerClockS™, FemtoClock™
類型： 頻率合成器
PLL： 是
輸入： 晶體
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 無/是
頻率 - 最大： 625MHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 16-TSSOP
包裝： 管件
其它名稱： 843252AGLF
ICS843252
FEMTOCLOCKTM CRYSTAL-TO- 3.3V LVPECL FREQUENCY SYNTHESIZER
IDT / ICS 3.3V LVPECL FREQUENCY SYNTHESIZER
6
ICS843252AG REV. A NOVEMBER 3, 2008
Table 4C. LVPECL DC Characteristics, VCC = VCCO_A = VCCO_B = 3.3V ± 5%, VEE = 0V, TA = 0°C to 70°C
NOTE 1: Output termination with 50
to V
CCO_A, _B – 2V.
Table 5. Crystal Characteristics
NOTE: Characterized using an 18pF parallel resonant crystal.
AC Electrical Characteristics
Table 6. AC Characteristics, VCC = VCCO_A = VCCO_B = 3.3V ± 5%, VEE = 0V, TA = 0°C to 70°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the
device is mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after
thermal equilibrium has been reached under these conditions.
NOTE 1: Defined as skew between outputs at the same supply voltages and with equal load conditions. Measured at the output
differential cross points.
NOTE 2: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 3: Please refer to the Phase Noise Plots.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
VOH
Output High Voltage; NOTE 1
VCCO_X – 1.4
VCCO_X – 0.9
V
VOL
Output Low Voltage; NOTE 1
VCCO_X – 2.0
VCCO_X – 1.7
V
VSWING
Peak-to-Peak Output Voltage Swing
0.6
1.0
V
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
Mode of Oscillation
Fundamental
Frequency
FB_SEL = ÷25
19.6
27.2
MHz
FB_SEL = ÷32
15.313
21.25
MHz
Equivalent Series Resistance (ESR)
50
Shunt Capacitance
7pF
Drive Level
1mW
Parameter
Symbol
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency Range
Output Divider = ÷ 1
490
680
MHz
Output Divider = ÷ 2
245
340
MHz
Output Divider = ÷ 3
163.33
226.67
MHz
Output Divider = ÷ 4
122.5
170
MHz
Output Divider = ÷ 5
98
136
MHz
Output Divider = ÷8
61.25
85
MHz
tsk(o)
Output Skew; NOTE 1, 2
Outputs @ Same Frequency
80
ps
Outputs @ Different Frequencies
190
ps
tjit()
RMS Phase Jitter, (Random);
NOTE 3
625MHz, (1.875MHz – 20MHz)
0.36
ps
312.5MHz, (1.875MHz – 20MHz)
0.43
ps
156.25MHz, (1.875MHz – 20MHz)
0.47
ps
125MHz, (1.875MHz – 20MHz)
0.47
ps
tR / tF
Output Rise/Fall Time
20% to 80%
300
700
ps
odc
Output Duty Cycle
47
53
%
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