FEMTOCLOCK CRYSTAL-TO-LVDS CLOCK GENERATOR IDT / ICS LVDS CLOCK GEN" />
參數(shù)資料
型號(hào)： ICS843251AGI-14LFT
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 2/15頁(yè)
文件大?。?/td> 0K
描述： IC CLK GEN ETHERNET 25MHZ 8TSSOP
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™, FemtoClock™
類(lèi)型： 時(shí)鐘發(fā)生器
PLL： 是
輸入： 晶體
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 170MHz
除法器/乘法器： 是/是
電源電壓： 2.375 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 8-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 8-TSSOP
包裝： 帶卷 (TR)
ICS844251-14
FEMTOCLOCK CRYSTAL-TO-LVDS CLOCK GENERATOR
IDT / ICS LVDS CLOCK GENERATOR
10
ICS844251BG-14 REV. A NOVEMBER 19, 2012
Schematic Example
Figure 5 shows an example of ICS844251-14 application
schematic. In this example, the device is operated at VDD = 3.3V.
The decoupling capacitor should be located as close as possible
to the power pin. The 18pF parallel resonant 25MHz crystal is
used. The C1 = 27pF and C2 = 27pF are recommended for
frequency accuracy. For different board layouts, the C1 and C2
may be slightly adjusted for optimizing frequency accuracy. For the
LVDS output drivers, place a 100
resistor as close to the receiver
as possible.
Figure 5. ICS844251-14 Schematic Example
C2
27pF
RD1
Not Install
U1
1
2
3
4
8
7
6
5
VDDA
GND
XTAL_OUT
XTAL_IN
VDD
Q
nQ
FREQ_SEL
R4
50
C3
0.1u
Zo = 50 Ohm
To Logic
Input
pins
FREQ_SEL
VDDA
C7
0.1uF
C1
27pF
RU1
1K
Set Logic
Input to
'0'
VDD
Alternate
LVDS
Termination
R3
50
VDD
Zo = 50 Ohm
VDD
+
-
Set Logic
Input to
'1'
VDD
+
-
Q
Zo = 50 Ohm
nQ
C4
10u
C5
0.01u
Logic Input Pin Examples
X1
25 MHz
nQ
RD2
1K
1 8 p F
RU2
Not Install
To Logic
Input
pins
R1
10
Q
R2
100
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