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參數(shù)資料
| 型號(hào)： | ICS843004AGI-04 |
| 英文描述： | FEMTOCLOCKS-TM CRYSTAL/LVCMOS-TO- 3.3V LVPECL FREQUENCY SYNTHESIZER |
| 中文描述： | FEMTOCLOCKS -商標(biāo)CRYSTAL/LVCMOS-TO- 3.3 LVPECL的頻率合成器 |
| 文件頁數(shù)： | 8/14頁 |
| 文件大?。?/td> | 186K |
| 代理商： | ICS843004AGI-04 |
843004AGI-04
www.icst.com/products/hiperclocks.html
REV. A FEBRUARY 15, 2006
8
Integrated
Circuit
Systems, Inc.
ICS843004I-04
F
EMTO
C
LOCKS
C
RYSTAL
/LVCMOS-
TO
-
3.3V LVPECL F
REQUENCY
S
YNTHESIZER
T
ERMINATION
FOR
3.3V LVPECL O
UTPUT
The clock layout topology shown below is a typical ter-
mination for LVPECL outputs. The two different layouts
mentioned are recommended only as guidelines.
V
CC
- 2V
50
Ω
50
Ω
RTT
Z
o
= 50
Ω
Z
o
= 50
Ω
FOUT
FIN
RTT =
Z
o
1
((V
OH
+ V
OL
) / (V
CC
– 2)) – 2
3.3V
125
Ω
125
Ω
84
Ω
84
Ω
Z
o
= 50
Ω
Z
o
= 50
Ω
FOUT
FIN
FOUT and nFOUT are low impedance follower outputs
that generate ECL/LVPECL compatible outputs. There-
fore, terminating resistors (DC current path to ground)
or current sources must be used for functionality. These
outputs are designed to drive 50
Ω
transmission lines.
F
IGURE
4B. LVPECL O
UTPUT
T
ERMINATION
F
IGURE
4A. LVPECL O
UTPUT
T
ERMINATION
Matched impedance techniques should be used to maxi-
mize operating frequency and minimize signal distor-
tion.
Figures 4A and 4B
show two different layouts which
are recommended only as guidelines. Other suitable
clock layouts may exist and it would be recommended
that the board designers simulate to guarantee compat-
ibility across all printed circuit and clock component pro-
cess variations.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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