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參數(shù)資料
| 型號： | ICS843003AGI-01LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 8/9頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER LVPECL 24-TSSOP |
| 標準包裝： | 2,500 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:3 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 680MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 843003AGI-01LFT |
8
Precision Edge
SY100EP111U
Micrel, Inc.
M9999-021511
hbwhelp@micrel.com or (408) 955-1690
TERMINATION RECOMMENDATIONS
R2
82
R2
82
ZO = 50
+3.3V
Vt = VCC –2V
R1
130
R1
130
+3.3V
Figure 1. Parallel Termination–Thevenin Equivalent
Note 1.
For +2.5V systems: R1 = 250, R2 = 62.5
Z = 50
50
50
46 to 50
+3.3V
“source”
“destination”
Rb
Figure 2. Three-Resistor “Y–Termination”
Note 1.
Power-saving alternative to Thevenin termination.
Note 2.
Place termination resistors as close to destination inputs as possible.
Note 3.
R
b resistor sets the DC bias voltage, equal to Vt.
+3.3V
50
ZO = 50
0.01F
VBB
R2
82
+3.3V
R1
130
R1
130
R2
82
Vt = VCC –2V
Q
/Q
+3.3V
Figure 3. Terminating Unused I/O
Note 1.
Unused output (/Q) must be terminated to balance the output.
Note 2.
Micrel's differential I/O logic devices include a V
BB reference pin .
Note 3.
Connect unused input through 50 to VBB. Bypass with a 0.01F capacitor to VCC, not GND.
Note 4.
For +2.5V systems: R1 = 250, R2 = 62.5.
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