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參數(shù)資料
| 型號： | ICS843002AKI-41T |
| 英文描述： | 700MHz, FEMTOCLOCKS-TM VCXO BASED SONET/SDH JITTER ATTENUATOR |
| 中文描述： | 700MHz的，F(xiàn)EMTOCLOCKS，商標VCXO的基于SONET / SDH的抖動衰減器 |
| 文件頁數(shù)： | 16/21頁 |
| 文件大?。?/td> | 279K |
| 代理商： | ICS843002AKI-41T |
843002AKI-41
www.icst.com/products/hiperclocks.html
REV. A JUNE 1, 2005
16
Integrated
Circuit
Systems, Inc.
ICS843002I-41
700MH
Z
, F
EMTO
C
LOCKS
VCXO B
ASED
SONET/SDH J
ITTER
A
TTENUATOR
PRELIMINARY
S
INGLE
E
NDED
C
LOCK
I
NPUT
I
NTERFACE
When using a LVCMOS or LVTTL clock driver, the clock
input is connected to the CLKx (CLK0 or CLK1) input pin. The
nCLKx (nCLK0 or nCLK1) pin is left unconnected. To help
reduce interference with the internal VCO circuits, an external
resistor can be placed in series with the clock signal right
near the CLKx input pin. Combined with the input pin
capacitance, this resistor acts as a low pass signal filter.
The typical value for this optional series filter resistor is 100
Ω
.
This will lower both the amplitude and edge rate of the clock
input signal. In the case of a very short clock trace a series
termination resistor may not be needed.
F
IGURE
6. S
INGLE
-E
NDED
C
LOCK
I
NPUT
I
NTERFACE
3.3V
CLK
nCLK
3.3V
(no connection)
Differential
Input Stage
LVTTL or
LVCMOS
Series
Termination
Optional
Series
Filter
Resistor
nCLKx
CLKx
Internal Device Circuitry
External Circuitry
50k
Ω
50k
Ω
50k
Ω
相關PDF資料 |
PDF描述 |
|---|---|
| ICS843002I-41 | 700MHz, FEMTOCLOCKS-TM VCXO BASED SONET/SDH JITTER ATTENUATOR |
| ICS843002 | FEMTOCLOCKS⑩ CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER |
| ICS843002AG | FEMTOCLOCKS⑩ CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER |
| ICS843002AGLF | FEMTOCLOCKS⑩ CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER |
| ICS843002AGLFT | FEMTOCLOCKS⑩ CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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