參數(shù)資料
型號(hào)： ICS843001AGI-22LFT
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘產(chǎn)生/分配
英文描述： 640 MHz, OTHER CLOCK GENERATOR, PDSO24
封裝： 4.40 X 7.80 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-24
文件頁(yè)數(shù)： 1/17頁(yè)
文件大?。?/td> 432K
代理商： ICS843001AGI-22LFT
843001AGI-22
www.icst.com/products/hiperclocks.html
REV. A AUGUST 1, 2005
1
Integrated
Circuit
Systems, Inc.
ICS843001I-22
FEMTOCLOCKSCRYSTAL/LVCMOS-TO-
3.3V, 2.5V LVPECL FREQUENCY SYNTHESIZER
GENERAL DESCRIPTION
The ICS843001I-22 is a a highly versatile, low
phase noise LVPECL/LVCMOS Synthesizer
which can generate low jitter reference clocks for
a variety of communications applications and is
a member of the HiPerClocksTM family of high
performance clock solutions from ICS. The dual
crystal interface allows the synthesizer to support up to two
communications standards in a given application (i.e. 1GB
Ethernet with a 25MHz crystal and 1Gb Fibre Channel
using a 25.5625MHz cr ystal). The r ms phase jitter
performance is typically less than 1ps, thus making the
device acceptable for use in demanding applications such
as OC48 SONET and 10Gb Ethernet. The ICS843001I-22
is packaged in a small 24-pin TSSOP package.
FEATURES
One 3.3V or 2.5V LVPECL output pair and
one LVCMOS/LVTTL output
Selectable crystal oscillator interface
or LVCMOS/LVTTL single-ended input
VCO range: 490MHz - 640MHz
Output frequency range: 490MHz - 640MHz
Supports the following applications:
SONET, Ethernet, Fibre Channel, Serial ATA, and HDTV
RMS phase jitter @ 125MHz (1.875MHz - 20MHz):
0.5ps (typical)
Full 3.3V or 2.5V supply modes
-40°C to 85°C ambient operating temperature
Available in both, Standard and RoHS/Lead-Free
compliant packages
HiPerClockS
ICS
PIN ASSIGNMENT
11
10
01
00
01
10
11
Phase
Detector
VCO
490MHz -640MHz
000 ÷18
001 ÷22
010 ÷24
011 ÷25
100 ÷32 (default)
101 ÷40
N
000
÷1
001
÷2
010
÷3
011
÷4 (default)
100
÷5
101
÷6
110
÷8
111
÷10
M
3
OSC
ICS843001I-22
24-Lead TSSOP
4.40mm x 7.8mm x 0.92mm
package body
G Package
Top View
VCCO_LVCMOS
N0
N1
N2
VCCO_LVPECL
Q
nQ
VEE
VCCA
VCC
XTAL_OUT1
XTAL_IN1
1
2
3
4
5
6
7
8
9
10
11
12
REF_OUT
VEE
OE
M2
M1
M0
MR
SEL1
SEL0
CLK
XTAL_IN0
XTAL_OUT0
24
23
22
21
20
19
18
17
16
15
14
13
BLOCK DIAGRAM
N2:N0
SEL0
SEL1
XTAL_IN0
XTAL_OUT0
XTAL_IN1
XTAL_OUT1
CLK
MR
M2:M0
OE
Q
nQ
Pulldown
REF_OUT
CONTROL INPUT FUNCTION TABLE
Pullup/Pulldown
t
u
p
n
I
l
o
r
t
n
o
Cs
t
u
p
t
u
O
E
OQ
n
/
QT
U
O
_
F
E
R
0Z
-
h
g
i
HZ
-
h
g
i
H
1Z
-
h
g
i
He
v
i
t
c
A
T
A
O
L
Fe
v
i
t
c
AZ
-
h
g
i
H
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PDF描述
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