參數(shù)資料
型號： ICS83905AGIT
元件分類： XO, clock
英文描述： 100 MHz, OTHER CLOCK GENERATOR, PDSO16
封裝： 4.40 X 5 MM, 0.92 MM HEIGHT, MO-153, TSSOP-16
文件頁數(shù)： 4/16頁
文件大?。?/td> 259K
代理商： ICS83905AGIT
83905AGI
http://www.icst.com/products/hiperclocks.html
REV. B MAY 16, 2005
12
Integrated
Circuit
Systems, Inc.
ICS83905I
LOW SKEW, 1:6 CRYSTAL INTERFACE-TO-
LVCMOS / LVTTL FANOUT BUFFER
LAYOUT GUIDELINE
Figure 2 shows an example of ICS83905I application schematic.
In this example, the device is operated at V
DD = 3.3V and VDDO =
3.3V. The decoupling capacitors should be located as close as
possible to the power pins. The input is driven by an 18pF load
resonant quartz crystal. The tuning capacitors (C1, C2) are fairly
accurate, but minor adjustments might be required. For the
LVCMOS output drivers, two termination examples are shown
in the schematic. For additional termination, examples are shown
in the LVCMOS Termination Application Note.
FIGURE 2. Schematic of Recommended Layout
VDD
R2
31
C6
.1uF
VDDO
ENABLE 2
R4
100
Zo = 50 Ohm
VDD = 3.3V
C2
15pf
VDD
C1
15pF
LVCMOS
ENABLE 1
CL = 18 pf
Optional Termination
R3
100
C4
.1uF
LVCMOS
Zo = 50 Ohm
VDDO
U1
ICS83905I
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
XTAL_OUT
ENABLE 2
GND
BCLK0
VDDO
BCLK1
GND
BCLK2
VDD
BCLK3
GND
BCLK4
VDDO
BCLK5
ENABLE 1
XTAL_IN
C3
10uF
VDDO = 3.3V
Unused outputs can be left floating. There should be
no trace attached to unused outputs. Device
characterized and specification limits set with all
outputs terminated.
C5
.1uF
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PDF描述
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