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參數(shù)資料
| 型號： | ICS8312AYLFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 11/18頁 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFF 1:12 250MHZ 32-LQFP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:12 |
| 差分 - 輸入:輸出： | 無/無 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS，LVTTL |
| 頻率 - 最大： | 250MHz |
| 電源電壓： | 1.6 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 8312AYLFT |
ICS8312
LOW SKEW, 1-TO-12 LVCMOS/LVTTL FANOUT BUFFER
IDT / ICS LVCMOS/LVTTL FANOUT BUFFER
2
ICS8312AY REV. D JULY 3, 2008
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 5, 8, 12, 16,
17, 21, 25, 29
GND
Power
Power supply ground.
2, 7
VDD
Power
Positive supply pins.
3
CLK_EN
Input
Pullup
Synchronous control for enabling and disabling clock outputs.
LVCMOS / LVTTL interface levels.
4
CLK
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
6
OE
Input
Pullup
Output enable. Controls enabling and disabling of outputs Q[0:11].
LVCMOS / LVTTL interface levels.
9, 11, 13, 15,
18, 20, 22, 24,
26, 28, 30, 32
Q11, Q10, Q9, Q8,
Q7, Q6, Q5, Q4,
Q3, Q2, Q1, Q0
Output
Single-ended clock outputs. LVCMOS/LVTTL interface levels.
10, 14, 19, 23,
27, 31
VDDO
Power
Output supply pins.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN Input Pulldown Resistor
51
k
CPD
Power Dissipation Capacitance
(per output)
VDDO = 3.465V
19
pF
VDDO = 2.625V
18
pF
VDDO = 2V
16
pF
ROUT
Output Impedance
VDDO = 3.3V ± 5%
7
VDDO = 2.5V ± 5%
7
VDDO = 1.8V ± 0.2V
10
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PDF描述 |
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參數(shù)描述 |
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