參數(shù)資料
型號: ICS650G-36LF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 1/8頁
文件大小: 0K
描述: IC CLOCK NETWORK/PCI 16-TSSOP
產(chǎn)品變化通告: Product Discontinuation 09/Feb/2012
標(biāo)準(zhǔn)包裝: 96
類型: 時鐘/頻率合成器
PLL: 帶旁路
輸入: 時鐘,晶體
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:4
差分 - 輸入:輸出: 無/無
頻率 - 最大: 25MHz
除法器/乘法器: 無/無
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 管件
其它名稱: 650G-36LF
DATASHEET
NETWORKING AND PCI CLOCK SOURCE
ICS650-36
IDT / ICS NETWORKING AND PCI CLOCK SOURCE
1
ICS650-36
REV F 051310
Description
The ICS650-36 is a low cost frequency generator designed
to support networking and PCI applications. Using
analog/digital Phase Locked-Loop (PLL) techniques, the
device uses a standard fundamental mode, inexpensive
crystal input of 25 MHz to produce four output clocks
supporting LAN, PCI, and 100M SDRAM functions.
The device also has a power down feature that tri-states the
clock outputs and turns off the PLL when the PDTS pin is
taken low.
Features
Packaged in 16-pin TSSOP
Pb (lead) free package
Replaces multiple crystals and oscillators
Input crystal or clock frequency of 25 MHz
Fixed reference output frequency of 25 MHz
Selectable output frequencies of 33.3, 33.333, 50,
66.666, 100, and 125 MHz
Duty cycle of 40/60
Operating voltage of 3.3 V
Advanced, low-power CMOS process
Industrial and commercial temperature ranges
Block Diagram
X1/ICLK
X2
PLL1
PLL2
Crystal
Oscillator/
Clock
Buffer
25 MHz
crystal
input
External capacitors
may be required.
VDD
GND
PDTS (all outputs and PLLs)
CLK1
3
PLL3
CLK3
CLK2
REF
Select/
Control
Circuit
3
S2:0
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PDF描述
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參數(shù)描述
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