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參數(shù)資料
| 型號(hào)： | ICS601G-01T |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類(lèi)： | 時(shí)鐘產(chǎn)生/分配 |
| 英文描述： | 156 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| 封裝： | 4.40 MM, 0.65 MM PITCH, TSSOP-16 |
| 文件頁(yè)數(shù)： | 2/9頁(yè) |
| 文件大?。?/td> | 267K |
| 代理商： | ICS601G-01T |
LOW PHASE NOISE CLOCK MULTIPLIER
MDS 601-01 L
2
Revision 111204
In te gr ated Circuit Systems ● 525 Ra ce Street, San Jose, CA 9512 6 ● tel (4 08) 297-1 201 ● www.icst.com
ICS601-01
Pin Assignment
Multiplier Select Table
0 = connect directly to ground
1 = connect directly to VDD
Pin Descriptions
1
2
3
VDD
4
REFEN
5
6
GND
7
8
GND
REFOUT
S3
S1
GND
X2
S2
VDD
16
CLK
VDD
X1/ICLK
S0
OE
15
14
13
12
11
10
9
16 Pin (150 mil) TSSOP or SOIC
S3
S2
S1 S0
CLK (see note 2 on following page)
00
0
TEST
00
0
1
TEST
00
1
0
Input x1
00
1
Input x3
01
0
Input x4
01
0
1
Input x5
01
1
0
Input x6
01
1
Input x8
10
0
TEST
10
0
1
Crystal osc. pass through (no PLL)
10
1
0
Input x2
10
1
TEST
11
0
Input x8
11
0
1
Input x10
11
1
0
Input x12
11
1
Input x16
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
CLK
Output
Clock output from VCO. Output frequency equals the input frequency times multiplier.
2
REFEN
Input
Reference clock enable. Turns off the buffered crystal oscillator clock (stops low) when low.
3
VDD
Power
Connect to +3.3V or +5V. Must match other VDDs.
4
VDD
Power
Connect to +3.3V or +5V. Must match other VDDs.
5
VDD
Power
Connect to +3.3V or +5V. Must match other VDDs.
6
X2
XO
Crystal connection. Connect to a 10 - 27 MHz fundamental parallel mode crystal.
Leave disconnected for an external clock input.
7
S1
Input
Multiplier select pin 1. Determines CLK output per table above. Internal pull-up.
8
X1/ICLK
XI
Crystal connection. Connect to a 10 - 27 MHz fundamental parallel mode crystal or clock.
9
S2
Input
Multiplier select pin 2. Determines CLK output per table above. Internal pull-up.
10
S3
Input
Multiplier select pin 3. Determines CLK output per table above. Internal pull-up.
11
S0
Input
Multiplier select pin 0. Determines CLK output per table above. Internal pull-up.
12
OE
Input
Output Enable. Tri-states both output clocks when low. Internal pull-up.
13
REFOUT
Output
Buffered crystal oscillator clock output. Controlled by REFIN.
14 - 16
GND
Power
Connect to ground.
ICS601-01
LOW PHASE NOISE CLOCK MULTIPLIER
TSD
IDT / ICS LOW PHASE NOISE CLOCK MULTIPLIER
ICS601-01
2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS601M-01 | 156 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| ICS601G-01I | 156 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| ICS601G-21ILFT | 220 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| ICS601G-21ILF | 220 MHz, OTHER CLOCK GENERATOR, PDSO16 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| ICS601G-21LF | 功能描述:IC CLOCK MULTIPLIER 16-TSSOP RoHS:是 類(lèi)別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 類(lèi)型:時(shí)鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類(lèi)型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤(pán) 供應(yīng)商設(shè)備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱(chēng):844S012AKI-01LFT |
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