參數(shù)資料
型號： ICS570BLF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 7/11頁
文件大?。?/td> 0K
描述： IC MULTIPLIER/ZDB 8-SOIC
產(chǎn)品培訓模塊： Clock Distibution and Generation 1.0
特色產(chǎn)品： ICS570 Zero Delay Buffer (ZDB)
標準包裝： 97
系列： ClockBlocks™
類型： 扇出配送，擴展頻譜時鐘發(fā)生器，零延遲緩沖器
PLL： 是
輸入： 時鐘
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 無/無
頻率 - 最大： 170MHz
除法器/乘法器： 是/是
電源電壓： 3.15 V ~ 3.45 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應商設備封裝： 8-SOIC
包裝： 管件
產(chǎn)品目錄頁面： 1252 (CN2011-ZH PDF)
其它名稱： 570BLF
800-1073
800-1073-5
800-1073-ND
ICS570
MULTIPLIER AND ZERO DELAY BUFFER
ZDB AND MULTIPLIER
IDT / ICS MULTIPLIER AND ZERO DELAY BUFFER
5
ICS570
REV K 073007
Clock Period Jitter Tables (ICS570B)
All jitter values are considered typical measured at 25
° C with 27termination resistor and 15 pF loads on both CLK
and CLK/2. The feedback is from CLK/2 to FBIN. Note that if an output is unused, it should be left unconnected to
improve output jitter on the active output clocks.
Absolute and One Sigma Jitter (ps)
1
0
75
2x
±155
110
1x
±55
20
1
M
4.6875
32x
±165
120
16x
±55
20
1
37.5
4x
±160
110
2x
±50
20
CLK = 50M
CLK/2 = 25M
S
CLKIN
Multiplier
P to P
1 sigma
Multiplier
P to P
1 sigma
0
M
8.333
6x
±110
80
3x
±55
20
0
1
6.25
8x
±125
90
4x
±50
20
M
0
3.125
16x
±130
90
8x
±55
20
M
4.167
12x
±120
90
6x
±55
20
M
1
2.5
20x
±115
90
10x
±55
20
1
0
25
2x
±130
50
1x
±55
20
1
M
1.5625
32x
±120
90
16x
±55
20
1
12.5
4x
±120
60
2x
±55
20
CLK = 100M
CLK/2 = 50M
S
CLKIN
Multiplier
P to P
1 sigma
Multiplier
P to P
1 sigma
0
M
16.667
6x
±100
70
3x
±45
20
0
1
12.5
8x
±100
70
4x
±45
20
M
0
6.25
16x
±110
80
8x
±45
20
M
8.333
12x
±100
70
6x
±45
20
M
1
5
20x
±105
70
10x
±40
20
1
0
50
2x
±90
60
1x
±40
20
1
M
3.125
32x
±95
70
16x
±45
20
1
25
4x
±105
70
2x
±60
20
CLK = 150M
CLK/2 = 75M
S
CLKIN
Multiplier
P to P
1 sigma
Multiplier
P to P
1 sigma
0
M
25
6x
±115
70
3x
±50
20
0
1
18.375
8x
±120
80
4x
±50
20
M
0
9.375
16x
±130
90
8x
±50
20
M
12.5
12x
±130
90
6x
±45
20
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PDF描述
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