參數(shù)資料
型號: ICS570
英文描述: Multiplier and Zero Delay Buffer
中文描述: 乘數(shù)和零延遲緩沖器
文件頁數(shù): 5/9頁
文件大小: 97K
代理商: ICS570
Multiplier and Zero Delay Buffer
MDS 570 I
5
Revision 030905
Integrated Circuit Systems, Inc.
525 Race Street, San Jose, CA 95126
tel (408) 297-1201
www.icst.com
ICS570
Clock Period Jitter Tables (ICS570B)
All jitter values are considered typical measured at 25
°
C with 27
termination resistor and 15 pF loads on
both CLK and CLK/2. The feedback is from CLK/2 to FBIN. Note that if an output is unused, it should be left
unconnected to improve output jitter on the active output clocks.
Absolute and One Sigma Jitter (ps)
Absolute and One Sigma Jitter (ps)
Absolute and One Sigma Jitter (ps)
CLK = 50M
P to P
±110
±125
±130
±120
±115
±130
±120
±120
CLK/2 = 25M
P to P
±55
±50
±55
±55
±55
±55
±55
±55
S1
0
0
M
M
M
1
1
1
S0
M
1
0
M
1
0
M
1
CLKIN (MHz)
8.333
6.25
3.125
4.167
2.5
25
1.5625
12.5
Multiplier
6x
8x
16x
12x
20x
2x
32x
4x
1 sigma
80
90
90
90
90
50
90
60
Multiplier
3x
4x
8x
6x
10x
1x
16x
2x
1 sigma
20
20
20
20
20
20
20
20
CLK = 100M
P to P
±100
±100
±110
±100
±105
±90
±95
±105
CLK/2 = 50M
P to P
±45
±45
±45
±45
±40
±40
±45
±60
S1
0
0
M
M
M
1
1
1
S0
M
1
0
M
1
0
M
1
CLKIN (MHz)
16.667
12.5
6.25
8.333
5
50
3.125
25
Multiplier
6x
8x
16x
12x
20x
2x
32x
4x
1 sigma
70
70
80
70
70
60
70
70
Multiplier
3x
4x
8x
6x
10x
1x
16x
2x
1 sigma
20
20
20
20
20
20
20
20
CLK = 150M
P to P
±115
±120
±130
±130
±130
±115
±130
±110
CLK/2 = 75M
P to P
±50
±50
±50
±45
±45
±45
±50
±60
S1
0
0
M
M
M
1
1
1
S0
M
1
0
M
1
0
M
1
CLKIN (MHz)
25
18.375
9.375
12.5
7.5
75
4.6875
37.5
Multiplier
6x
8x
16x
12x
20x
2x
32x
4x
1 sigma
70
80
90
90
90
90
90
70
Multiplier
3x
4x
8x
6x
10x
1x
16x
2x
1 sigma
20
20
20
20
20
20
20
20
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