參數(shù)資料
型號： ICS548AM-03LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 5/7頁
文件大?。?/td> 0K
描述： IC CLK INVERTER/DIVIDER 16-SOIC
標準包裝： 2,500
類型： 時鐘/頻率合成器，時鐘發(fā)生器，扇出配送
PLL： 是
輸入： 時鐘
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:3
差分 - 輸入:輸出： 無/無
頻率 - 最大： 120MHz
除法器/乘法器： 是/是
電源電壓： 3.13 V ~ 3.47 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.154"，3.90mm 寬）
供應商設備封裝： 16-SOIC
包裝： 帶卷 (TR)
其它名稱： 548AM-03LFT
ICS548A-03
LOW SKEW CLOCK INVERTER AND DIVIDER
CLOCK DIVIDER
IDT / ICS LOW SKEW CLOCK INVERTER AND DIVIDER
5
ICS548A-03
REV C 063006
AC Electrical Characteristics
VDD = 3.3 V, Ambient Temperature -40 to +85
° C, unless stated otherwise
Note 1: The phase relationship between input and output clocks can change at power up. Use the ICS570 or
ICS527 Zero Delay Buffers for a guaranteed phase relationship.
Thermal Characteristics
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency, clock
input, PLL on
fIN
10
120
MHz
Input Frequency, clock
input, PLL off
fIN
0160
MHz
Output Frequency (see
table on page 2)
fOUT
Mode dependent
0
120
MHz
Output Clock Rise Time
tOR
0.8 to 2.0 V
0.84
ns
Output Clock Fall Time
tOF
2.0 to 0.8 V
0.74
ns
Output Clock Duty Cycle
tDC
At VDD/2
45
50
55
%
Output Enable Time, OE
high to output on
50
ns
Output Disable Time, OE
to tri-state
50
ns
Absolute Clock Period
Jitter. PLL modes
Deviation from mean
150
ps
One Sigma Clock Period
Jitter, PLL modes
60
ps
Output clock skew for
CLK, CLK, or CLK/2
At VDD/2
850
ps
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Thermal Resistance Junction to
Ambient
θJA
Still air
120
° C/W
θJA
1 m/s air flow
115
° C/W
θJA
3 m/s air flow
105
° C/W
Thermal Resistance Junction to Case
θJC
58
° C/W
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PDF描述
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參數(shù)描述
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ICS548G-05ILF 制造商:Integrated Device Technology Inc 功能描述:IC CLOCK MULT T1/E1 16-TSSOP
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