參數(shù)資料
型號(hào): ICS527R-02LF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 8/10頁
文件大小: 0K
描述: IC CLK SLICER ZDB CONFIG 28-SSOP
產(chǎn)品培訓(xùn)模塊: Clock Distibution and Generation 1.0
標(biāo)準(zhǔn)包裝: 48
類型: 扇出緩沖器(分配),零延遲緩沖
PLL:
輸入: PECL
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:2
差分 - 輸入:輸出: 是/無
頻率 - 最大: 160MHz
除法器/乘法器: 是/是
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 28-SSOP(0.154",3.90mm 寬)
供應(yīng)商設(shè)備封裝: 28-QSOP
包裝: 管件
其它名稱: 527R-02LF
800-1051
800-1051-5
800-1051-ND
ICS527-02
CLOCK SLICER USER CONFIGURABLE PECL INPUT ZERO DELAY BUFFER
PECL ZDB AND MULTIPLIER/DIVIDER
IDT / ICS CLOCK SLICER USER CONFIGURABLE PECL INPUT ZERO DELAY BUFFER 7
ICS527-02
REV J 051310
AC Electrical Characteristics
Unless stated otherwise, VDD = 3.3 V ±5%, Ambient Temperature -40 to +85
° C
Note 1: Assumes clocks with same rise time, measured from rising edges at VDD/2.
Input Capacitance
CIN
Except PECLIN and
FBIN
5pF
Short Circuit Current
IOS
±70
mA
On-chip pull-up resistor
RPU
270
k
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
FIN
1.5
200
MHz
Output Frequency, CLK1
FOUT
0 to +70
° C4
160
MHz
-40 to +85
° C4
140
MHz
Output Rise Time
tOR
0.8 to 2.0 V, CL=15 pF
1
ns
Output Fall Time
tOF
2.0 to 0.8 V, CL=15 pF
1
ns
Output Duty Cycle (% high
time)
tOD
Measured at VDD/2,
CL=15 pF
45
50
55
%
Power Down Time, PDTS low to
clocks tri-stated
50
ns
Power Up Time, PDTS high to
clocks stable
10
ms
Absolute Clock Period Jitter
tja
Deviation from mean
± 90
ps
One sigma Clock Period Jitter
tjs
40
ps
Input to output skew
tIO
PECLIN to CLK1,
Note 1
-250
250
ps
Device to device skew
tpi
Common PECLIN,
measured at FBIN
0500
ps
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
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PDF描述
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參數(shù)描述
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