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參數(shù)資料
| 型號： | ICS342 |
| 英文描述： | FIELD PROGRAMMABLE DUAL OUTPUT SS VERSACLOCK SYNTHESIZER |
| 中文描述： | 現(xiàn)場可編程雙輸出不銹鋼VERSACLOCK合成器 |
| 文件頁數(shù)： | 1/7頁 |
| 文件大?。?/td> | 151K |
| 代理商： | ICS342 |
ICS342
MDS 342 F
1
Revision 090704
Integrated Circuit Systems, Inc.
●
525 Race Street, San Jose, CA 95126
●
tel (408) 297-1201
●
www.icst.com
Field Programmable Dual Output SS VersaClock Synthesizer
Description
The ICS342 is a low cost, dual-output, field
programmable clock synthesizer. The ICS342 can
generate two output frequencies from 250 kHz to 200
MHz, using up to two independently configurable PLLs.
The outputs may employ Spread Spectrum techniques
to reduce system electro-magnetic interference (EMI).
Using ICS’ VersaClock
TM
software to configure the
PLL and output, the ICS342 contains a One-Time
Programmable (OTP) ROM to allow field
programmability. Programming features include 2
selectable configuration registers. Using Phase-Locked
Loop (PLL) techniques, the device runs from a
standard fundamental mode, inexpensive crystal, or
clock. It can replace multiple crystals and oscillators,
saving board space and cost.
The device also has a power down feature that
tri-states the clock outputs and turns off the PLLs when
the PDTS pin is taken low.
The ICS342 is also available in factory programmed
custom versions for high-volume applications.
Features
8-pin SOIC package
Highly accurate frequency generation
M/N Multiplier PLL: M = 1...2048, N = 1...1024
Output clock frequencies up to 200 MHz
Two ROM locations for frequency and spread
selection
Spread spectrum capability for lower system EMI
Center or Down Spread up to 4% total
Selectable 32 kHz or 120 kHz modulation
Input crystal frequency from 5 to 27 MHz
Input clock frequency from 2 to 50 MHz
Operating voltage of 3.3 V
Advanced, low power CMOS process
For one output clock, use the ICS341. For three
output clocks, see the ICS343. For more than three
outputs, see the ICS345 or ICS348.
Available in Pb (lead) free packaging
Block Diagram
Crystal
Oscillator
PDTS (both outputs and PLL)
OTP ROM
with PLL
Divider
Values
SEL
VDD
GND
CLK1
CLK2
PLL Clock Synthesis,
Spred Spectrum and
Control Circuitry
X2
Crystal or
clock input
External capacitors are
required with a crystal input.
X1/ICLK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS342MIP | FIELD PROGRAMMABLE DUAL OUTPUT SS VERSACLOCK SYNTHESIZER |
| ICS342MLF | FIELD PROGRAMMABLE DUAL OUTPUT SS VERSACLOCK SYNTHESIZER |
| ICS342MP | FIELD PROGRAMMABLE DUAL OUTPUT SS VERSACLOCK SYNTHESIZER |
| ICS343MIP | Field Programmable Triple Output SS VersaClock Synthesizer |
| ICS343MLF | Field Programmable Triple Output SS VersaClock Synthesizer |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ICS342MLF | 制造商:ICS 制造商全稱:ICS 功能描述:FIELD PROGRAMMABLE DUAL OUTPUT SS VERSACLOCK SYNTHESIZER |
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