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參數(shù)資料
| 型號： | ICS1524AMLFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 13/24頁 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN SSTL_3/PECL 24-SOIC |
| 產(chǎn)品變化通告： | Product Discontinuation 09/Feb/2012 |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 類型： | 時鐘/頻率合成器，時鐘發(fā)生器，扇出配送 |
| PLL： | 是 |
| 輸入： | LVTTL，晶體 |
| 輸出： | PECL，SSTL-3 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:4 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-SOIC |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 1524AMLFT |
ICS1524A
20
ICS1524A Rev F 05/13/10
DPA Delay-16 Element Resolution
0
2
4
6
8
10
12
14
16
18
20
04
8
12
DPA Setting
ns
Delay
50 MHz - SVGA @ 72 Hz
157.5 MHz - SXGA @ 85 Hz
DPA Delay - 32 Element Resolution
0
5
10
15
20
25
30
35
40
45
0
4
8
1216
2024
28
DPA Setting
ns
De
la
y
25.175 MHz - VGA @ 60 Hz
78.75 MHz - XGA @ 75 Hz
16
DPA Delay - 64 Element Resolution
0
10
20
30
40
50
60
70
80
90
0
4
8
12
16
20
24
28
32
36
40
44
48
52
56
60
DPA Setting
n
s
Delay
12.27 MHz - NTSC
39.8 MHz - SVGA @ 60
32
64
Note:
Maximum number of data points used for this graph.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS1526GILF | IC VIDEO CLK SYNTHESIZER 16TSSOP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ICS1524M | 制造商:ICS 制造商全稱:ICS 功能描述:Dual Output Phase Controlled SSTL-3/PECL Clock Generator |
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