參數(shù)資料
型號： HD64570F8I
廠商： Hitachi,Ltd.
英文描述： Serial Communications Adaptor
中文描述： 串行通訊適配器
文件頁數(shù)： 14/469頁
文件大小： 2044K
代理商： HD64570F8I
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Rev. 0, 07/98, page iv of 11
5.7.3
Reset Operation ................................................................................................................. 237
Interrupt Enable Conditions ................................................................................. 237
5.8
Section 6
6.1
Direct Memory Access Controller (DMAC)
.......................................... 239
Overview............................................................................................................................ 239
6.1.1
Functions.............................................................................................................. 239
6.1.2
Configuration and Operation................................................................................ 240
Registers............................................................................................................................ 241
6.2.1
Channels 0, 2: Destination Address Register (DAR: DARL, DARH, DARB)/
Buffer Address Register (BAR: BARL, BARH, BARB)
Channels 1, 3: Buffer Address Register (BAR: BARL, BARH, BARB) .......... 241
6.2.2
Channels 0, 2: Chain Pointer Base (CPB)
Channels 1, 3: Source Address Register (SAR: SARL, SARH, SARB)/
Chain Pointer Base (CPB).................................................................................... 242
6.2.3
Current Descriptor Address Register (CDA: CDAL, CDAH)............................ 244
6.2.4
Error Descriptor Address Register (EDA: EDAL, EDAH) ................................ 245
6.2.5
Receive Buffer Length Register (BFL: BFLL, BFLH)....................................... 246
6.2.6
Byte Count Register (BCR: BCRL, BCRH) ....................................................... 247
6.2.7
DMA Status Register (DSR)................................................................................ 248
6.2.8
DMA Mode Register (DMR) ............................................................................... 251
6.2.9
Frame End Interrupt Counter (FCT) .................................................................... 253
6.2.10 DMA Interrupt Enable Register (DIR)................................................................. 254
6.2.11 DMA Command Register (DCR)......................................................................... 256
6.2.12 DMA Priority Control Register (PCR)................................................................. 258
6.2.13 DMA Master Enable Register (DMER)............................................................... 260
Descriptors......................................................................................................................... 261
6.3.1
Memory-to-MSCI Chained-Block Transfer Mode (Transmission) ..................... 261
6.3.2
MSCI-to-Memory Chained-Block Transfer Mode (Reception)........................... 263
Operating Modes ............................................................................................................... 265
6.4.1
Overview.............................................................................................................. 265
6.4.2
Memory-to/from-MSCI Single-Block Transfer Mode......................................... 267
6.4.3
Memory-to-MSCI Chained-Block Transfer Mode .............................................. 271
6.4.4
MSCI-to-Memory Chained-Block Transfer Mode .............................................. 285
6.4.5
DMAC Characteristics ......................................................................................... 299
Interrupts............................................................................................................................ 300
Reset Operation ................................................................................................................. 301
Precautions ........................................................................................................................ 301
6.2
6.3
6.4
6.5
6.6
6.7
Section 7
7.1
Timer
.................................................................................................................. 303
Overview............................................................................................................................ 303
7.1.1
Functions.............................................................................................................. 303
7.1.2
Configuration and Operation................................................................................ 303
Registers............................................................................................................................ 304
7.2
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PDF描述
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