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參數(shù)資料
| 型號： | HD6435368STF |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Single-Chip Microcomputer |
| 中文描述： | 單片機 |
| 文件頁數(shù)： | 207/487頁 |
| 文件大?。?/td> | 1408K |
| 代理商： | HD6435368STF |
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Bit 6
OCIEB
0
1
Description
Output compare interrupt request B (OCIB) is disabled.
Output compare interrupt request B (OCIB) is enabled.
(Initial value)
Bit 5—Output Compare Interrupt Enable A (OCIEA):
This bit selects whether to request
output compare interrupt A (OCIA) when output compare flag A (OCFA) in the timer
status/control register (TCSR) is set to 1.
Bit 5
OCIEA
0
1
Description
Output compare interrupt request A (OCIA) is disabled.
Output compare interrupt request A (OCIA) is enabled.
(Initial value)
Bit 4—Timer Overflow Interrupt Enable (OVIE):
This bit selects whether to request a free-
running timer overflow interrupt (FOVI) when the timer overflow flag (OVF) in the timer
status/control register (TCSR) is set to 1.
Bit 4
OVIE
0
1
Description
The free-running timer overflow interrupt request (FOVI) is disabled.
The free-running timer overflow interrupt request (FOVI) is enabled.
(Initial value)
Bit 3—Output Enable B (OEB):
This bit selects whether to enable or disable output of the logic
level selected by the OLVLB bit in the timer status/control register (TCSR) at the output compare
B pin when the FRC and OCRB values match.
Bit 3
OEB
0
1
Description
Output compare B output is disabled.
Output compare B output is enabled.
(Initial value)
Bit 2—Output Enable A (OEA):
This bit selects whether to enable or disable output of the logic
level selected by the OLVLA bit in the timer status/control register (TCSR) at the output compare
A pin when the FRC and OCRA values match.
190
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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