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參數(shù)資料
| 型號(hào)： | HD6433394TF |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Hitachi Single Chip Microcomputer |
| 中文描述： | 日立單片機(jī) |
| 文件頁(yè)數(shù)： | 552/746頁(yè) |
| 文件大小： | 2666K |
| 代理商： | HD6433394TF |
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523
RD
VF
PR ER FLER = 0
Error occurrence
RES
= 0 or
STBY
= 0
RES
= 0 or
STBY
= 0
RD
VF
PR
ER
FLER = 0
Program mode
Erase mode
Reset or
hardware standby
(hardware protection)
RD VF
PR
ER
FLER = 1
RD
VF
PR
ER
FLER = 1
Error protect mode
Error protect mode
(standby)
Software standby mode
FLMCR1, FLMCR2 (except FLER bit),
EBR2 initialized
FLMCR1, FLMCR2,
EBR2 initialized
Software standby mode
release
RD:
Memory read possible
VF:
Verify-read possible
PR:
Programming possible
ER:
Erasing possible
RD
:
Memory read not possible
VF
:
Verify-read not possible
PR
:
Programming not possible
ER
:
Erasing not possible
RES
= 0 or
STBY
= 0
Error occurrence
(software standby
mode)
Figure 21.14 Flash Memory State Transitions
21.4.6
Interrupt Handling during Flash Memory Programming and Erasing
All interrupts, including NMI input, should be disabled when flash memory is being programmed
or erased (while the P or E bit is set in FLMCR1) and while the boot program is executing in boot
mode
*1
, to give priority to the program or erase operation. There are three reasons for this:
1. Interrupt occurrence during programming or erasing might cause a violation of the
programming or erasing algorithm, with the result that normal operation could not be assured.
2. In the interrupt exception handling sequence during programming or erasing, the vector would
not be read correctly
*2
, possibly resulting in microcontroller runaway.
3. If an interrupt occurred during boot program execution, it would not be possible to execute the
normal boot mode sequence.
For these reasons, there are conditions for disabling interrupts in the on-board programming
modes alone, as an exception to the general rule. However, this provision does not guarantee
normal erasing and programming or microcontroller operation.
All requests, including NMI, must therefore be disabled inside and outside the microcontroller
when flash memory is programmed or erased. Interrupts are also disabled in the error protection
state while the P or E bit setting in FLMCR1 is held.
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