參數(shù)資料
型號： HD6433045
廠商： Hitachi,Ltd.
英文描述： Multipole Connector; Leaded Process Compatible:No; Peak Reflow Compatible (260 C):No RoHS Compliant: No
中文描述： 日立單片機(jī)
文件頁數(shù)： 405/867頁
文件大?。?/td> 2771K
代理商： HD6433045
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3
Table 10-11 (d) ITU Operating Modes (Channel 3)
Register Settings
TSNC
TMDR
TFCR
Reset-
Synchro-
nized PWM Buffering
o
CMD1 = 0
CMD1 = 0
TOCR
TOER
TIOR3
TCR3
Comple-
mentary
PWM
o
*
3
Output
Level
Select
—
—
—
Synchro-
nization
SYNC3 = 1 —
o
o
Master
Enable
o
*
1
o
o
Clear
Select
o
o
o
Clock
Select
o
o
o
Operating Mode
Synchronous preset
PWM mode
Output compare A
MDF
FDIR PWM
—
—
—
XTGD
—
—
—
IOA
o
—
IOA2 = 0
Other bits
unrestricted
o
IOB
o
o
*
2
o
o
PWM3 = 1 CMD1 = 0
PWM3 = 0 CMD1 = 0
o
o
o
—
—
Output compare B
o
—
—
o
CMD1 = 0
CMD1 = 0
o
—
—
o
IOB2 = 0
Other bits
unrestricted
o
o
o
Input capture A
o
—
—
PWM3 = 0 CMD1 = 0
CMD1 = 0
o
—
—
EA3 ignored IOA2 = 1
Other bits
unrestricted
EB3 ignored
o
Other bits
unrestricted
o
*
1
o
o
Other bits
Input capture B
o
—
—
PWM3 = 0 CMD1 = 0
CMD1 = 0
o
—
—
IOA2 = 1
Other bits
unrestricted
o
o
o
Counter By compare
clearing
match/input
capture A
By compare
match/input
capture B
Syn-
chronous
clear
Complementary
PWM mode
Reset-synchronized
PWM mode
Buffering
(BRA)
o
—
—
o
Illegal setting:
o
*
4
CMD1 = 1
CMD0 = 0
CMD1 = 0
o
—
—
o
CCLR1 = 0
CCLR0 = 1
o
o
—
—
o
CMD1 = 0
o
—
—
o
*
1
o
o
CCLR1 = 1
CCLR0 = 0
o
SYNC3 = 1 —
—
o
Illegal setting:
o
CMD1 = 1
CMD0 = 0
CMD1 = 1
CMD0 = 0
CMD1 = 1
CMD0 = 1
o
o
—
—
o
*
1
o
o
CCLR1 = 1
CCLR0 = 1
o
o
*
3
—
—
—
CMD1 = 1
CMD0 = 0
CMD1 = 1
CMD0 = 1
o
o
o
*
6
o
o
—
—
CCLR1 = 0
CCLR0 = 0
CCLR1 = 0
CCLR0 = 1
o
o
*
5
o
—
—
—
o
o
*
6
o
o
—
—
o
o
—
—
o
BFA3 = 1
Other bits
unrestricted
BFB3 = 1
Other bits
unrestricted
—
—
o
*
1
o
o
o
Buffering
(BRB)
o
—
—
o
o
o
—
—
o
*
1
o
o
o
o
Legend:
Setting available (valid). — Setting does not affect this mode.
Notes: 1. Master enable bit settings are valid only during waveform output.
2. The input capture function cannot be used in PWM mode. If compare match A and compare match B occur simultaneously, the compare match signal is inhibited.
3. Do not set both channels 3 and 4 for synchronous operation when complementary PWM mode is selected.
4. The counter cannot be cleared by input capture A when reset-synchronized PWM mode is selected.
5. In complementary PWM mode, select the same clock source for channels 3 and 4.
6. Use the input capture A function in channel 1.
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PDF描述
HD6433047 CONN HEADER .100 SNGL STR 36POS
HD6433048 Hitachi Single-Chip Microcomputer
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HD6433045TF 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microcontroller
HD6433045VF 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microcontroller
HD6433045VTF 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microcontroller
HD6433047 制造商:HITACHI 制造商全稱:Hitachi Semiconductor 功能描述:Hitachi Single-Chip Microcomputer
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